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ORCA
2系列的FPGA
数据表
1999年6月
G
指数
A
绝对最大额定值， 129
加法器（见LUT操作模式）
架构
概述， 5
PLC ， 22
PIC ， 25
B
双向缓冲器（比迪），14 ，17，18 ，20，22
（还参见路由和SLIC）
比特流（见FPGA CON组fi guration ）
比特流错误检查， 47
（另见操作FPGA州）
边界扫描， 54-59
C
时钟分配网络， 37-39
选择时钟输入引脚， 39
时钟使能（ CE ） ， 1 ， 5 ， 7 ， 15 ， 16 ， 24 ， 134
比较器（见LUT操作模式）
配置（见FPGA的国家行动
或FPGA配置）
控制输入， 5 ， 7
E
电气特性， 130
错误检查（见FPGA配置）
F
5 V容限I / O， 26-27 ， 64
FPGA配置
配置帧格式， 43-46
配置模式， 47 ， 158-160
异步外设模式， 49 ， 163
菊花链， 51
主并行模式， 47
主串行模式， 162
从并行模式， 48 ， 50 ， 161 ， 166
从串模式， 49-50 ， 165
同步外设模式， 48 ， 164
数据格式， 43-45
运用
ORCA
代工生成RAM中的数据， 43
FPGA国运营的， 40-43
配置方面， 41
初始化， 40
其他配置选项， 43
部分重配置， 43
重新配置， 42
启动， 41
GSR （见GSRN ）
GSRN ， 6，7， 16 ，37， 134
I
IEEE
标准1149.1 ， 1
（另见边界扫描）
初始化（见FPGA国实施）
输入/输出缓冲器（见PICS）
测量条件， 169
输出缓冲器特性， 170-172
J
JTAG （见边界扫描）
L
查找表（ LUT ），工作模式， 7-15
法器子模式， 10
计数器子模式， 11
平等的比较， 11
逻辑模式， 7-9
内存模式， 12-15
异步内存， 12
同步内存， 13
乘法器子模式， 11
纹波模式， 10
LSR ， 5-7 ， 15-16
M
最大额定值（见绝对最大额定值）
乘数（见LUT操作模式）
O
ORCA
铸造开发系统概述， 4
订购信息， 189
包装矩阵， 190
封装选项， 189
温度选项， 189
电压选项， 189
输出（见PICS）
P
封装外形图纸， 174-186
包装矩阵， 190
封装外形图纸， 173
84引脚PLCC ， 174
100引脚TQFP ， 175
144引脚TQFP ， 176
189
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