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数据表
1999年6月
ORCA
2系列的FPGA
网络群体已经各线。为了有效途径nibble-
广公共汽车，每一组网络连接线已经可以连接
以只有一个半字节的位同时为XH和
XL 。例如， hIQ0线只能连接到
XH0和在xl0线和hIQ1线可以连接
只有到XH1和XL1线中，提供了等，缓冲器
用于从所述的XH和XL线路上传送信号
HiQ的线和从HiQ的线路上的XH和XL
线。因此，从一个象限到连接
另一种可以仅使用两个XH线进行（一个在
每个象限）和一个interquad线。
Interquad路由
（续）
在图29中的HiQ的块，从一个XH线
象限连接通过CIP其对应的
相反的象限中，创建一个路径跨越
PLC数组。因为被动的CIP是用于连接
2 XH线，三态信号可以被路由上的两个
在相反的象限XH线，然后就可以
通过这个CIP连接
.
在HIQ块， 20 HIQ线跨一个数组
水平方向。 20 HIQ行包括四个
携带
VXH[3]
VXH[2]
VXH[1]
VXH[0]
VX4[7]
VX4[6]
VX4[5]
VX4[4]
VX1[7]
VX1[6]
VX1[5]
VX1[4]
VXL[3]
VXL[2]
VXL[1]
VXL[0]
VX1[3]
VX1[2]
VX1[1]
VX1[0]
INB[4]
INB[3]
INB[2]
INB[1]
INB[0]
GSRN
hIQ3[4]
hIQ3[3]
hIQ3[2]
hIQ3[1]
hIQ3[0]
hIQ2[4]
hIQ2[3]
hIQ2[2]
hIQ2[1]
hIQ2[0]
CKB
CKT
VX4[3]
VX4[2]
VX4[1]
VX4[0]
hIQ3[4]
hIQ3[3]
hIQ3[2]
hIQ3[1]
hIQ3[0]
hIQ2[4]
hIQ2[3]
hIQ2[2]
hIQ2[1]
hIQ2[0]
hIQ1[4]
hIQ1[3]
hIQ1[2]
hIQ1[1]
hIQ1[0]
hIQ0[4]
hIQ0[3]
hIQ0[2]
hIQ0[1]
hIQ0[0]
VX4[3]
VX4[2]
VX4[1]
VX4[0]
5-4537(F).r3
hIQ1[4]
hIQ1[3]
hIQ1[2]
hIQ1[1]
hIQ1[0]
hIQ0[4]
hIQ0[3]
hIQ0[2]
hIQ0[1]
hIQ0[0]
VX4[7]
VX4[6]
VX4[5]
VX4[4]
VX1[7]
VX1[6]
VX1[5]
VX1[4]
VXL[3]
VXL[2]
VXL[1]
VXL[0]
VXH[3]
VXH[2]
VXH[1]
VXH[0]
携带
VX1[3]
VX1[2]
VX1[1]
VX1[0]
INT[4]
INT[3]
INT[2]
INT[1]
INT[0]
GSRN
CKB
CKT
图29. HIQ座详细
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