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CD54HC4017 ， CD74HC4017
测试电路和波形
（续）
t
r
C
L
时钟
输入
90%
10%
t
H(H)
t
f
C
L
V
CC
50%
GND
t
小时（ L）的
V
CC
数据
输入
t
素（H ）
t
TLH
90%
产量
t
PLH
t
REM
V
CC
设，重设
或预设
t
SU（ L）
t
THL
90%
50%
10%
t
PHL
50%
GND
50%
GND
IC
C
L
50pF
图3.慧聪设置时间，保持时间，拆模时间和传输延迟时间边沿触发
时序逻辑电路
时序图
时钟
主
RESET
时钟
启用
“0”
“1”
Q
C
L
P
N
C
L
R
FF细节
Q
“2”
“3”
“4”
“5”
“6”
“7”
“8”
“9”
终奌站
算
C
L
D
P
N
C
L
C
L
PN
C
L
C
L
P
N
C
L
0
1
2
3
4
5
6
7
8
9
0
1
2
C
L
C
图4中。
图5中。
6
