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FLEX 10KE嵌入式可编程逻辑系列数据手册
ClockLock &
ClockBoost
特点
为了支持高速设计， FLEX 10KE器件提供可选
ClockLock和含有一个锁相环ClockBoost电路（PLL）的
是，用于提高设计速度和降低资源的使用。该
ClockLock电路使用一个同步的PLL ，降低了时钟延迟
和歪斜的装置内。本次减持减少时钟到输出
设置时间，同时保持零等待时间。该ClockBoost电路，
它提供了时钟倍频器，允许设计人员提升设备
通过在装置内的资源共享区的效率。该ClockBoost
功能允许设计人员分发低速时钟和繁殖
设备上的时钟。合并后， ClockLock和ClockBoost功能
提供系统性能显著改进和
带宽。
所有FLEX 10KE设备，除EPF10K50E和EPF10K200E设备，
支持ClockLock和ClockBoost电路。 EPF10K50S和
EPF10K200S设备支持该电路。支持时钟 - 设备
锁定和ClockBoost电路是有区别的用“X ”后缀
订货代码;例如，在EPF10K200SFC672-1X设备支持
该电路。
在FLEX 10KE器件的ClockLock和ClockBoost功能
通过MAX + PLUS II软件中启用。外部设备是不
使用这些功能需要。该ClockLock的输出
ClockBoost电路不提供任何的器件引脚。
该ClockLock和ClockBoost电路锁定到的上升沿
输入时钟。该电路的输出可以驱动的寄存器的时钟输入端
只;所产生的时钟不能被选通或倒置。
专用时钟引脚（ GCLK1 ）提供时钟给ClockLock和
ClockBoost电路。当专用时钟引脚驱动
ClockLock或ClockBoost电路，它不能在其他地方开了
装置。
为需要的乘法和非倍频的时钟，该设计
在电路板上的时钟跟踪可以被连接到所述
GCLK1
引脚。在
MAX + PLUS II软件中，
GCLK1
针可以同时并行ClockLock和
ClockBoost电路中的FLEX 10KE设备。然而，当这两个
电路中使用的另一个时钟引脚不能使用。
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Altera公司。
