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SX -A系列FPGA
表2-21
A54SX16A时序特性（续）
（最坏情况下的商业条件，V
CCA
= 2.25 V
,
V
CCI
= 3.0 V，T
J
= 70°C)
-3速度
参数
t
INYL
t
INYH
t
INYL
描述
输入数据垫为Y低5 V PCI
输入数据垫为Y高5 V TTL
输入数据垫为Y低5 V TTL
-2速度
速度-1
标准。速度
-F速度
分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。单位
0.7
0.5
0.7
0.8
0.5
0.8
0.9
0.6
0.9
1.1
0.7
1.1
1.5
0.9
1.5
ns
ns
ns
输入模块预测布线延迟
2
t
IRD1
t
IRD2
t
IRD3
t
IRD4
t
IRD8
t
IRD12
注意事项：
1.对于双宏模块，使用吨
PD
+ t
RD1
+ t
PDN
, t
RCO
+ t
RD1
+ t
PDN
或T
PD1
+ t
RD1
+ t
SUD
，适当的指令。
2.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应被用于估计装置
性能。布线后的时序分析或模拟需要确定实际性能。
FO = 1路由延迟
FO = 2路由延迟
FO = 3路由延迟
FO = 4路由延迟
FO = 8路由延迟
FO = 12路由延迟
0.3
0.4
0.5
0.7
1.2
1.7
0.3
0.5
0.6
0.8
1.4
2.0
0.3
0.5
0.7
0.9
1.5
2.2
0.4
0.6
0.8
1.0
0.8
2.6
0.6
0.8
1.1
1.4
2.5
3.6
ns
ns
ns
ns
ns
ns
v5.1
2-27
