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PD703100-33 ， 703100-40 ， 703101-33 ， 703102-33
（四）写时序（高速DRAM页面访问：上页） （ 2/2 ）
TCPW
CLKOUT （输出）
TO1
Tdaw
TO2
<58>
<59>
A0到A23 （输出）
列地址
<63>
<64>
RASN （输出）
<83>
<81>
UCAS （输出）
LCAS （输出）
<89>
<88>
<65>
OE （输出）
<84>
<92>
<85>
WE （输出）
<91>
<90>
<86>
D0到D15 （ I / O）
<87>
WAIT （输入）
备注1 。
这是由于以下情况的定时（ n = 0至3 ，第XX = 0003 ， 10 13） 。
由于DRCn寄存器的CPCxx位（ TCPW ）等待数：1
由于DRCn寄存器（ TDAW ）的DACxx位等待数：1
2.
虚线表示高阻抗。
3.
n = 0到7
初步数据表U13995EJ1V0DS00
95
