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PD703031A ， 703031AY ， 703033A ， 703033AY ， 70F3033A ， 70F3033AY
（ 10 ） I 2 C总线模式（
PD703031AY ， 703033AY ， 70F3033AY只）
2
(T
A
= -40+ 85°C ，V
DD
= 4.0 5.5 V ， EV
DD
= 3.0 5.5 V ，V
SS
= EV
SS
= 0 V)
参数
符号
普通模式
分钟。
SCLN时钟频率
总线空闲时间（间
停止/启动条件）
保持时间
注1
高速模式
分钟。
0
1.3
马克斯。
400
–
单位
马克斯。
100
–
–
<74>
f
CLK
t
BUF
0
4.7
千赫
s
s
s
s
s
s
<75>
<76>
<77>
<78>
t
高清： STA
t
低
t
高
t
SU ： STA
4.0
4.7
4.0
4.7
–
–
–
–
0.6
1.3
0.6
0.6
–
–
–
–
SCLN时钟低电平宽度
SCLN时钟高电平宽度
用于启动/重新启动建立时间
条件
数据保持
时间
CBUS
兼容
主
我C模式
数据建立时间
SDAn和SCLN信号上升
时间
SDAn和SCLN信号的下降
时间
停止条件的建立时间
尖峰脉冲宽度
由输入滤波器抑制
每个电容负载
公交线路
2
<79>
t
高清： DAT
5.0
–
–
–
0
<80>
<81>
t
苏： DAT
t
R
注2
–
–
1000
0
注2
0.9
注3
s
ns
ns
250
–
100
注4
–
注5
20 + 0.1Cb
300
<82>
t
F
–
300
20 + 0.1Cb
注5
300
ns
<83>
<84>
t
苏： STO
t
SP
4.0
–
–
–
0.6
0
–
50
s
ns
–
Cb
–
400
–
400
pF
注意事项1 。
在启动状态下，第一个时钟脉冲后的保持时间产生的。
2.
该系统需要最小的300纳秒内保持时间为SDAn信号（在V
IHmin 。
.
SCLN的
信号），以占据在SCLN的下降沿的未定义区域。
3.
如果系统没有扩展SCLN低信号保持时间（T
低
） ，只有最大数据保持时间
(t
HD
:
DAT
）需要满足。
2
2
4.
在高速模式下的IC总线可以在正常模式下的IC总线系统中使用。在这种情况下，设置
高速模式I
2
C总线，使之满足以下的条件。
如果系统没有扩展SCLN信号的低电平状态保持时间：
t
HD
:
DAT
≥
250纳秒
如果系统扩展了SCLN信号的低电平状态保持时间：
发送以下数据位到SDAn行前SCLN放线（T
R最大。
+ t
SU
:
DAT
= 1000
+ 250 = 1250 NS ：普通模式我
2
C总线规范） 。
5.
CB ：一条总线的总电容（单位： pF）的
备注
n = 0, 1
44
数据表U14734EJ1V0DS00
