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TMS320LF2407A ， TMS320LF2406A ， TMS320LF2403A ， TMS320LF2402A
TMS320LC2406A ， TMS320LC2404A ， TMS320LC2403A ， TMS320LC2402A
DSP控制器
SPRS145J - 2000年7月 - 修订2004年11月
倍增器
该TMS320x240xA设备使用一个16 ×16位硬件乘法器，能够计算一个签名或中
无符号的32位乘积在一个机器周期。所有的乘法指令，除了MPYU （乘无符号）
指令执行有符号乘法运算。即，乘以两个数字被视为
二进制补数，其结果是一个32位的二进制补数。有两个相关的寄存器
与乘法器，如下：
D
16位暂存寄存器（ TREG ），它保存操作数中的一个，用于对乘法器
D
32位乘积寄存器（ PREG ）持有的产物
四个产品移模式（ PM）可在PREG输出（ PSCALE ） 。这些换档模式是有用的
执行乘法/累加运算，进行小数运算，或证明分数的产品。
的状态寄存器ST1中的PM字段指定了下午变速模式，如表6所示。
表6. PSCALE产品移模式
PM
00
01
10
11
移
无移位
左1
左4
（右）6
描述
产品饲料CALU或数据总线无移位
可以去除产生的额外符号位二进制补乘法，产生Q31产品
可以去除16x13产生额外的4符号位乘法二进制补到生产Q31产品时，
使用乘法逐一个-13位常数
尺度上的产品，允许多达128个产品的积累，而不累加器溢出的可能性
该产品可移位一个位来补偿获得的相乘两个16位的额外的符号位
二进制补数（ MPY指令） 。一个四比特移位时配合使用的MPY指令与
短的立即值（13位或更小），以消除获得乘以一个16位数字的四个额外的符号位
由13位数字。最后， PREG的输出可以是右移6位以使最多的执行
连续128乘/累加无溢出的可能性。
对LT （负载TREG ）指令通常装入TREG以提供一个操作数（来自数据总线），以及MPY
（乘）指令提供第二个操作数（也从数据总线） 。乘法也可以
使用MPY指令时用一个13位的立即数执行。然后，将获得的产物每
两个周期。当代码执行多个乘法和产品的总和， CPU支持的流水线
与使用以往的产品CALU操作TREG装载操作。流水线操作
与装载TREG并行运行，包括：用PREG （ LTP ）的负载ACC ;添加PREG到ACC （ LTA ） ;添加PREG
到ACC和移位TREG输入数据（ DMOV ）在数据存储器下一地址（ LTD） ;并减去PREG从ACC
（ LTS ） 。
两个乘法/累加指令（ MAC和MACD ）充分利用的计算带宽
乘法器，允许这两个操作数的同步处理。这些操作的数据可以是
通过的程序和数据总线的方式传送到乘法器的每个周期。这有利于单周期
与重复（ RPT ）指令使用时，乘法/累加。在这些指令中，系数
通过程序地址生成（ PAGEN ）逻辑生成地址，而数据地址
通过数据地址产生（ DAGEN ）逻辑产生。这允许重复的指令来访问所述值
从系数表顺序和步骤的通过数据中的任何间接寻址模式。
MACD的指令，当重复的，支持过滤器构造（加权的移动平均值） ，这样，当
执行求和的副产物，该样品数据移入存储器，以腾出空间用于下一次取样，并
扔掉旧的样本。
邮政信箱1443
休斯敦，得克萨斯州77251-1443
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