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CY74FCT823T
9位总线接口寄存器
SCCS069 - 2001年10月
D
D
D
D
D
D
D
D
D
D
功能，引脚和驱动器兼容
随着FCT ， F逻辑和AM29823
降低V
OH
（通常= 3.3V ）的版本
相当于FCT功能
边缘速率控制电路
显著改善噪声
特征
I
关闭
支持部分掉电模式
手术
匹配的上升和下降时间
完全兼容TTL输入和
输出逻辑电平
ESD保护超过JESD 22
- 2000 -V人体模型（ A114 -A ）
- 200 -V机型号（ A115 -A ）
- 1000 -V带电器件模型（ C101 ）
64 mA输出灌电流
32 mA输出源电流
高速并行注册
正边沿触发的D型触发器
缓冲的公共时钟使能（ EN）和
异步清零（ CLR ）输入
P，Q ，或SO封装
（ TOP VIEW ）
OE
D
0
D
1
D
2
D
3
D
4
D
5
D
6
D
7
D
8
CLR
GND
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
V
CC
Y
0
Y
1
Y
2
Y
3
Y
4
Y
5
Y
6
Y
7
Y
8
EN
CP
描述
该总线接口寄存器的目的是消除缓冲寄存器现有所需的额外软件包和
实施平价更宽的地址/数据路径或总线提供额外的数据宽度。该CY74FCT823T是
9位宽的缓冲寄存器时钟使能（ EN）和清除（ CLR）的投入，是理想的奇偶校验总线接口
在高性能的微程序的系统。此设备是非常适合用作输出端口需要高
I
OL
/I
OH
.
该器件是专为高容性负载驱动能力，同时提供低电容总线负载
在两个输入端和输出端。输出是专为低电容总线负载在高阻抗状态。
这个装置是用我的部分掉电应用完全指定
关闭
。在我
关闭
电路禁止输出，
防止有害的电流回流通过该装置，当它被断电。
引脚说明
名字
D
CLR
CP
Y
EN
OE
I / O
I
I
O
O
I
I
D触发器的数据输入端
当CLR为低和OE为低电平时， Q输出是低的。当CLR为高电平时，数据可以被输入到寄存器中。
时钟脉冲的寄存器。把数据输入上的低到高的时钟转变的寄存器。
寄存器3态输出
时钟使能。当EN为低时，在D输入的数据传送到在低到高的时钟转变的Q输出端。当
EN为高时，Q输出不改变的状态，而不管数据或时钟输入端的电压的。
输出控制。当OE为高电平时，Y输出处于高阻抗状态。当OE为低电平时，真正的寄存器中的数据是本
在在Y输出。
描述
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版权
2001年，德州仪器
PRODUCTION数据信息为出版日期。
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标准保修。生产加工并不包括
所有测试参数。
邮政信箱655303
达拉斯，德克萨斯州75265
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