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SN54LVC138A ， SN74LVC138A
3线路至8线路解码器/多路解复用器
SCAS291I - 1993年3月 - 修订1998年10月
D
D
D
D
D
D
D
EPIC
（增强型性能注入
CMOS ）亚微米工艺
ESD保护超过2000伏每
MIL -STD -883方法3015 ;超过200 V
使用机型号（ C = 200 pF的， R = 0 ）
闭锁性能超过250毫安每
JESD 17
典型的V
OLP
（输出地弹跳）
< 0.8 V电压V
CC
= 3.3 V ，T
A
= 25°C
典型的V
OHV
（输出V
OH
冲）
> 2 V在V
CC
= 3.3 V ，T
A
= 25°C
输入接受电压为5.5 V
封装选择包括塑料
小外形封装（ D） ，收缩型小外形
（ DB ） ，以及超薄紧缩小外形（ PW ）
封装，陶瓷芯片载体（ FK ）和
平（W ）封装，和沾酱（J ）
SN54LVC138A 。 。 。 J或W包装
SN74LVC138A 。 。 。 D， DB或PW包装
（ TOP VIEW ）
A
B
C
G2A
G2B
G1
Y7
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
Y0
Y1
Y2
Y3
Y4
Y5
Y6
SN54LVC138A 。 。 。 FK包装
（ TOP VIEW ）
B
A
NC
V
CC
Y0
C
G2A
NC
G2B
G1
3
4
5
6
7
8
2 1 20 19
18
17
16
15
14
9 10 11 12 13
描述
该SN54LVC138A 3行至8行译码器/
多路分解器是专为2.7 V至3.6 V V
CC
操作和SN74LVC138A 3行至8行
译码器/多路分离器被设计为1.65 V至
3.6-V V
CC
操作。
Y1
Y2
NC
Y3
Y4
的' LVC138A装置被设计用于高
NC - 无内部连接
高性能内存解码或数据路由
需要很短的传播应用
延迟时间。在高性能的存储器系统中，这些解码器最小化系统解码的效果。
当用高速存储器使用快速启动电路，这些解码器的延迟时间和所
存储器的使能时间通常比存储器的典型访问时间更少。这意味着
由解码器引入的有效系统延迟可以忽略不计。
在二元选择输入和三个条件使能输入选择八个输出线之一。两
低电平有效使能输入和一个高电平有效使能输入减少了对外部门或逆变器时，
不断扩大。 24线译码器可以在不外接转换器来实现，32线译码器要求
只有一台变频器。一个使能输入端可以被用作一个数据输入，用于解复用的应用程序。
输入可驱动无论从3.3 V或5 V设备。此功能允许使用这些设备作为翻译
在混合3.3 V / 5 V系统环境。
该SN54LVC138A的特点是工作在-55 ° C至125°C的整个军用温度范围。
该SN74LVC138A的特点是操作温度范围为-40 ° C至85°C 。
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PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
1998年，德州仪器
关于产品符合MIL -PRF- 38535 ，所有参数进行测试
除非另有说明。在所有其他产品，生产
加工不一定包括所有参数进行测试。
邮政信箱655303
达拉斯，德克萨斯州75265
Y7
GND
NC
Y6
Y5
1
