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数据表
1999年6月
ORCA
2系列的FPGA
上的CCLK的下降沿。图46示出了
在一个菊花加载多个FPGA连接
链CON组fi guration 。
CCLK为菊花链设备的产生
这是在从串模式的不同而不同的
铅设备CON组fi guration模式。一个主paral-
LEL模式设备使用其内部时序发生器
产生在8倍的内存内部CCLK
地址率（ RCLK ） 。异步外围设备
模式器件输出8个CCLK每个写周期。
如果铅设备CON组fi gured在同步
外围设备或从机模式， CCLK被路由到铅
设备和所有的菊花链设备。
开发系统可以创建一个复合
为CON连接CON组fi guration比特流guring菊花链
FPGA中。该帧格式是一个同步码，长度计数
总比特流中，多个串接的数据
帧，每个设备的最终-CON的组fi guration框架，
后同步码，并在每个设备的附加音响LL位
串行链路。
正如图46中，在
INIT
引脚所有的FPGA
被连接在一起。这是必需的，以保证
即上电和初始化将正常工作。在
一般情况下， DONE引脚所有的FPGA也
连接在一起，如图所示，以保证所有的
FPGA的同时进入了启动状态。这
可以不需要，这取决于启动
序列所需。
FPGA CON组fi guration模式
（续）
链
多个FPGA可以CON连接用菊花gured
链中的FPGA 。菊花链采用了领先的FPGA
和一个或多个FPGA CON连接gured在从串行
模式。领先的FPGA可以CON组fi gured在任何模式
除了从并行模式。 （菊花链是不可用
能够与边界扫描ram_w指令，显示
后来讨论过。 ）
所有菊花链式连接的FPGA被串联连接。
每个FPGA读取和转移的序言和长度
正面CCLK进出负面CCLK计数
边缘。
已经接收到前导码的上游的FPGA
和长度计数输出高DOUT上，直到它有
接收到这样的数据帧的适当数量
下游的FPGA没有收到帧的起始位
（ 0 ） 。装载和重传的序言和后
长度计数到从设备的菊花链，带头
设备加载它CON组fi guration数据帧。加载
骗子的组fi guration数据继续领先设备后，
已收到CON组fi guration数据，如果其内部框架
位计数器还没有达到长度计数。当
CON组fi guration RAM是充分和比特数
接收小于所述长度计数音响视场中，FPGA
移动的任何其他数据列于DOUT 。
该CON组fi guration数据读入从设备的DIN
在CCLK的上升沿和移出DOUT
CCLK
A[17:0]
A[17:0]
DOUT
CCLK
DIN
DOUT
CCLK
DIN
DOUT
EPROM
D[7:0]
OE
CE
DONE
ORCA
系列
D[7:0]
FPGA
主
DONE
ORCA
系列
FPGA
从站＃ 1
DONE
INIT
HDC
最不发达国家
RCLK
V
DD
PRGM
M2
M1
M0
ORCA
系列
FPGA
SLAVE ＃ 2
V
DD
PRGM
节目
V
DD
V
DD
OR
GND
M2
M1
M0
INIT
HDC
最不发达国家
RCLK
V
DD
PRGM
M2
M1
M0
INIT
HDC
最不发达国家
RCLK
V
DD
5-4488(F)
图46.菊花链CON组fi guration示意图
朗讯科技公司
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