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IDT72264 / 72274可变宽度SUPERSYNC FIFO
（ 8192 ×18或16384 ×9 ）和（ 16384 ×18或32768 ×9 ）
商业温度范围
在串行方法中，
SEN
再加上
LD
用于加载
偏移通过串行输入（ SI ）寄存器。在并行
方法，
文
再加上
LD
可用于加载偏移
通过d个寄存器
n
.
任
再加上
LD
可以用来读取
从Q平行偏移
n
不管串行或
平行偏置负载选择。
在主复位（
太太
） ，读出和写入指针是
设置为FIFO的第一个位置。在FWFT行选择IDT
标准模式或FWFT模式。该
LD
引脚选择两个一
部分标志的默认设置（ 127或1023 ），并且还，串行或
并行编程。该标志被相应地更新。
该部分复位（
PRS
）还设置了读取和写入
指针的存储器的第一个位置。然而，该
模式设置，编程方法，以及部分标志偏移
不改变。该标志被相应地更新。
PRS
is
在中期操作中，当重现重置设备有用
编程偏移寄存器可能不太方便。
该重传功能允许读出指针被复位
到RAM阵列中的第一个位置。它是同步的，以
当RCLK
RT
为LOW 。这个功能是便于
发送多次相同的数据更多。
如果，在任何时间，在FIFO没有积极地执行功能，
该芯片将自动断电。如果出现这种情况既不
读或写操作发生在10个周期更快的时钟，
RCLK和WCLK 。在关机状态下，电源电流
消费（我
CC2
）为最小。启动任何操作
（通过激活控制输入），将立即采取设备
从关机状态。
该IDT72264 / 72274顷深度扩展。加
的外部元件是不必要的。该
IR
和
OR
功能，连同
任
和
文
中，使用以延长
总的FIFO存储器的容量。
在FS线，确保通过FIFO最佳的数据流。它
被连接到GND ，如果RCLK频率比WCLK更高
频率或到Vcc ，如果RCLK频率比低
WCLK频率
该IDT72264 / 72274采用IDT的高速制造
亚微米CMOS技术。
引脚配置（续）
11
10
09
08
07
06
05
DNC Q
5
Q
6
GND Q
4
Q
8
Q
10
Q
7
Q
9
V
CC
Q
2
Q
1
GND
1
D
0
D
2
D
3
D
4
D
5
D
6
D
9
D
7
D
8
Q
3
GND Q
0
D
11
D
10
D
13
D
12
D
15
D
14
D
17
D
16
引脚1代号
V
CC
苹果
Q
11
GND
Q
13
Q
12
Q
14
V
CC
04 GND Q
15
03
Q
17
Q
16
SEN
FS
02 DNC
01
A
OE任
GND
PAE HF FF
/ DNC
LD
WCLK
文
IR
RT
RCLK
EF
/ V
CC
PAF
GND
FWFT /
刘健PRS
SI
OR
B
C
D
E
F
G
H
J
K
L
3218 DRW 03
PGA （ G68-1 ，订货代码： G）
顶视图
笔记
:
1.当数据路径被选择为9位宽（MAC为HIGH时），D-
9
- D
17
可连接到地或悬空，Q
9
- Q
17
必须悬空。
2. DNC =不连接
3
