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RN5VS
输出的延迟时间
t
PLH
的定义如下：
1.在N沟道开漏输出的情况下：
当时间在该一个脉冲电压，提高从0.7V到+ V
DET
+ 2.0V被施加到V
DD
时间是A，和
在其中，该输出引脚（ OUT）被拉起的状态下的输出电压达到2.5V的时间
至5V由470KΩ的电阻是时间B，时间从A到B.时间的时间段
2.在CMOS输出的情况下：
当时间在该一个脉冲电压，提高从0.7V到+ V
DET
+ 2.0V被施加到V
DD
时间是A，和
当输出电压达到电压的时间（+ V
DET
+ 2.0V ） / 2的时间B中，从时间周期
通过时间B.时间
