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PSD813F2 ， PSD833F2 ， PSD834F2 ， PSD853F2 ， PSD854F2
表62.端口的外围数据模式读时序（ 3V器件）
-12
符号
t
AVQV -PA
t
SLQV -PA
t
RLQV -PA
RD到数据有效模式8031
t
DVQV -PA
t
QXRH -PA
t
RLRH -PA
t
RHQZ -PA
数据输入到数据输出有效
RD数据保持时间
RD脉冲宽度
RD到数据高阻
（注
1
)
（注
1
)
0
36
36
参数
地址有效到数据有效
CSI有效到数据有效
RD到数据有效
（注
1,4
)
条件
民
（注
3
)
最大
50
37
37
45
38
0
36
40
民
最大
50
45
40
45
40
0
46
45
民
-15
-20
涡轮
关闭
最大
50
50
45
50
45
+ 20
+ 20
单位
ns
ns
ns
ns
ns
ns
ns
ns
图48.外设I / O写时序
ALE / AS
A / D BUS
地址
数据输出
tWLQV
WR
（ PA ）
tWHQZ （ PA ）
tDVQV （ PA ）
端口A
数据输出
AI02898
表63.端口的外围数据模式写入时序（ 5V设备）
-70
符号
t
WLQV -PA
t
DVQV -PA
t
WHQZ -PA
注： 1 。
2.
3.
4.
5.
-90
最大
35
30
25
-15
单位
民
最大
40
38
33
ns
ns
ns
参数
WR到数据传输延迟
数据端口A的数据传输延迟
WR无效的端口A三态
条件
民
（注
2
)
（注
5
)
（注
2
)
最大最小
25
22
20
RD具有相同的定时的DS ， LDS ， UDS ，和PSEN （在8031组合模式）。
WR具有相同的时序为E， LDS ， UDS ， WRL ， WRH和信号。
任何输入用来选择A口数据外设模式。
数据已经稳定在端口A.
数据稳定在ADIO引脚上的端口A的数据
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