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RESET
2
8–BYPASS
6
OSC INHIBIT
14
3
T 1
8
4
出1
C
Q
恩
S
A
B
C
D
9
10
11
12
输出2
5
阶段
2到7
T 9
IN1
阶段
10 THRU
15
16
17
阶段
18 THRU
23
24
MC14536B
逻辑图
http://onsemi.com
1
7
时钟
抑制
15
MONO -IN
7
解码器
SET
解码器
OUT
13
VDD = 16 PIN
VSS = 8 PIN
