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+ 2.7V ，低功耗，双通道，
108ksps ，串行10位ADC ，采用8引脚μMAX封装
表1.串行输出数据流的内部和外部时钟模式
SCLK周期
DOUT （内部时钟）
DOUT （外部时钟）
1
EOC
1
2
1
1
3
1
1
4
5
6
D8
D8
7
D7
D7
8
D6
D6
9
D5
D5
10
D4
D4
11
D3
D3
12
D2
D2
13
D1
D1
14
D0
D0
15
S1
S1
16
S0
S0
CHID D9
CHID D9
MAX157/MAX159
等，因此， SNR由之比来计算
在RMS信号与RMS噪声（包括所有
减去基波频谱分量），所述第一
五次谐波和DC偏移。
串行时钟为MAX157 / MAX159 。选择一个时钟频率
昆西从100kHz至2.17MHz （外部时钟模式） 。
1 ）使用一个通用I / O口线在CPU上拉
CS / SHDN
低SCLK为低电平时。
2 ）等待最短的唤醒时间（t
WAKE
）试样
激活SCLK前田间。
3 ）激活的SCLK为至少16个时钟周期。该
第一个时钟下降沿将产生一个串行数据 -
三个领头的人流，接着是信
NEL识别，数字化输入的MSB
信号，和两个子比特。 DOUT在
SCLK的下降沿可在MSB优先换
垫子。观察SCLK到DOUT有效时间煤焦
动感画。数据应移入微处理器上
SCLK的上升沿。
4 ）拉
CS / SHDN
高点或在16个时钟后
边缘。如果
CS / SHDN
仍然很低，尾随零会
同步输出后分位。
5 ）同
CS / SHDN
高，等待至少为60ns （T
CS
） ，前
通过拉动起动一个新的转换
CS / SHDN
低。
A转换可以通过拉动中止
CS / SHDN
在转换结束前的高;等待至少为60ns
在开始之前，一个新的转换。
数据可以被输出或者在2个8位的序列或
不断。该字节包含的结果
转换填充有三个领头的人，该信
NEL识别的MSB之前，以及两个后子
位。如果串行时钟还没有经过最后一个被闲置
子位（ S 0）和
CS / SHDN
保持在较低水平， DOUT发送
尾随零。
信号与噪声失真比（ SINAD ）
信号与噪声失真是基波的比值
心理输入频率的RMS振幅RMS equiv-
alent所有其他ADC输出信号：
SINAD （ dB为单位） = 20
登录
（噪声信号
RMS
+失真）
RMS
有效位数（ ENOB ）
有效位数表示的ADC中的一个全局精度
特定的输入频率和采样速率。理想
ADC误差仅包括量化噪声。有
输入范围等于ADC的满量程范围内，
计算的比特的有效数量如下：
ENOB = （ SINAD - 1.76 ） / 6.02
总谐波失真（ THD ）
THD指前五个的RMS之和的比例谐波
将输入信号与基波自身的集成电路。这是
表示为：
THD = 20
登录
(
V
22
+ V
32
+ V
4 2
+ V
52
V
12
)
其中，V
1
是基波的振幅和V
2
通过
V
5
可通过5阶第2的振幅har-
MONICS 。
SPI和MICROWIRE接口
当采用SPI （图8a）或MICROWIRE （图8b）
接口设置CPOL = 0， CPHA = 0转换
首先在下降沿
CS / SHDN
（图8c ） 。两
个连续的8位数据都需要得到
来自ADC的整个10位的结果。 DOUT数据转换
在串行时钟的下降沿锁存到
微处理器在SCLK的上升沿。第8位的数据流
包含三个领头的人，其次是渠道identi-
fication和从MSB开始的第4个数据位。
第二个8位的数据流中包含的剩余
比特D5至D0，和子位S1和S0 。
无杂散动态范围（ SFDR ）
SFDR是基波RMS幅度之比
（最大信号成分）的RMS值
下一个最大的寄生成分，不含DC偏移。
连接标准接口
该MAX157 / MAX159接口完全兼容
SPI / QSPI和MICROWIRE标准的串行接口。
如果一个串行接口可用，树立了CPU的seri-
人接口作为主使CPU产生的
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