74VHC373
引脚说明
引脚名称
D
0
–D
7
LE
OE
O
0
–O
7
描述
数据输入
锁存使能输入
输出使能输入
三态输出
真值表
输入
LE
X
H
H
L
H
L
Z
X
O
0
输出
D
n
X
L
H
X
O
n
Z
L
H
O
0
OE
H
L
L
L
高电压电平
低电压电平
高阻抗
非物质
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0
前锁存高向低转换启动
功能说明
该VHC373包含八个D型锁存器带3态
标准输出。当锁存使能（ LE ）输入
在D高，数据
n
输入端进入锁存器。在这种CON-
条件时的锁存器是透明的，也就是说，锁存器输出将
每一次的D输入的变化而变化的状态。当LE是
低时，锁存器存储是存在于信息
在D输入建立时间高到低转录前
LE习得的。 3态输出的标准控制
由输出使能（ OE ）输入。当OE是低电平时，
标准输出在2态模式。当OE
高，标准的输出处于高阻抗
模式，但这并不与输入新的数据到干扰
所述锁存器。
逻辑图
请注意，该图仅用于逻辑操作的理解提供的，不应该被用来估计的传播延迟。
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