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PSD4XX家庭
该PSD4XX
架构
（续）
9.3.12 C口和D口 - 功能与结构
端口C和D是在功能和结构相同的，并且每一个可以被配置为执行
1以下操作模式的一个或多个：
t
标准的MCU I / O模式
t
PLD输入 - 直接输入到ZPLD
（ PSD4XXA2和ZPSD4XXA2只）
t
地址手续 - 锁存地址输出
- 端口C ： A [ 0-7]被分配到引脚PC [ 0-7 ]
- 端口D ： A [ 0-7] 8位复用总线或A [ 8-15 ] 16位复用
总线分配给引脚PD0-7 ]
t
数据端口
- 端口C ： D [ 0-7] 8位非复用总线
- 端口D ： D [ 8-15 ] 16位非复用总线
t
漏极开路 - 选择CMOS或开漏驱动器
图29和图30显示了端口C或D端子的结构。如果该引脚被配置为输出
端口，所述多路复用器选择的两个输入端为输出1 。如果该引脚被配置为输入，
的输入端连接到：
t
数据注册为输入的标准MCU I / O模式
or
t
ZPLD输入（ PSD4XXA2和ZPSD4XXA2只）
9.3.13端口E - 功能与结构
E端口可以被配置为执行以下一个或多个功能：
t
t
t
t
标准的MCU I / O模式
PLD I / O （ PSD4XXA2和ZPSD4XXA2只）
地址手续 - 锁存地址线A [ 0-7]被分配到引脚PE [ 0-7 ]
备用功能在 - 在这种模式下，输入端口E引脚是：
–
PE0
BHE或PSEN或WRH或UDS或SIZ0
–
PE1
- ALE
–
PE7
APD CLK ：时钟输入，自动断电计数器
图31示出一个端口E销的结构。控制逻辑模块选择的四分之一
通过多路复用器的引脚输出的来源。如果引脚配置为输入，输入
转到：
t
数据寄存器中的输入标准MCU I / O模式
or
t
PE宏单元的PLD输入（ PSD4XXA2和ZPSD4XXA2只）
or
t
备用功能在
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