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R
的Virtex -II FPGA平台：产品详细描述
表2：
支持差分信号I / O标准
I / O标准
LVPECL_33
LDT_25
LVDS_33
LVDS_25
LVDSEXT_33
LVDSEXT_25
BLVDS_25
ULVDS_25
产量
V
CCO
3.3
2.5
3.3
2.5
3.3
2.5
2.5
2.5
输入
V
CCO
不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
输入
V
REF
不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
产量
V
OD
490 mV至1.22V
0.430 - 0.670
0.250 - 0.400
0.250 - 0.400
0.330 - 0.700
0.330 - 0.700
0.250 - 0.450
0.430 - 0.670
表3：
支持的DCI I / O标准
I / O
标准
LVDCI_33
(1)
LVDCI_DV2_33
(1)
LVDCI_25
(1)
LVDCI_DV2_25
(1)
LVDCI_18
(1)
LVDCI_DV2_18
(1)
LVDCI_15
(1)
LVDCI_DV2_15
(1)
GTL_DCI
GTLP_DCI
产量
V
CCO
3.3
3.3
2.5
2.5
1.8
1.8
1.5
1.5
1.2
1.5
1.5
1.5
1.5
1.5
1.8
1.8
1.8
1.8
2.5
2.5
3.3
3.3
输入
V
CCO
3.3
3.3
2.5
2.5
1.8
1.8
1.5
1.5
1.2
1.5
1.5
1.5
1.5
1.5
1.8
1.8
1.8
1.8
2.5
2.5
3.3
3.3
输入
V
REF
不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
0.8
1.0
0.75
0.75
0.9
0.9
0.9
0.9
1.08
1.08
1.25
1.25
1.5
1.5
终止
TYPE
系列
系列
系列
系列
系列
系列
系列
系列
单身
单身
分裂
分裂
单身
单身
分裂
分裂
单身
单身
分裂
分裂
分裂
分裂
所有的用户IOB中有固定钳位二极管，以VCCO和
到地面。为输出，这些IOB的不兼容或
兼容5V的I / O标准。作为输入使用时，这些IOB的是
不正常5V容限，但可用于5V的I / O标
dards当外部的限流电阻使用。为
更多详细信息，请参阅“可承受5V的I / O ”技术话题
www.xilinx.com 。
表3
支持列表和数字CON组I / O标准
受控阻抗。看
数控阻抗
（DCI） ，
第8页。
HSTL_I_DCI
HSTL_II_DCI
HSTL_III_DCI
HSTL_IV_DCI
HSTL_I_DCI_18
HSTL_II_DCI_18
HSTL_III_DCI_18
HSTL_IV_DCI_18
SSTL2_I_DCI
(2)
SSTL2_II_DCI
(2)
SSTL3_I_DCI
(2)
SSTL3_II_DCI
(2)
注意事项：
1. LVDCI_XX和LVDCI_DV2_XX控制LVCMOS
阻抗缓冲器，匹配参考电阻或半
的基准电阻器。
2.这是SSTL兼容。
逻辑资源
IOB块包括六个存储元件，如图
图2中。
每个存储元件可以被配置既可以作为
边沿触发的D型触发器或作为电平敏感的锁存器。
在输入，输出和三态路径，一个或两个DDR稳压
存器都可以使用。
双倍数据速率直接完成由两个寄存器
每条路径，由上升沿同步于TER值（或下降
边）从两个不同的时钟网络。两个时钟信号
由DCM产生并且必须是180度的
阶段，如图
网络连接gure 3 。
有两个输入，输出
和三态数据信号，每个交替同步输出。
DS031-2 （ V3.0 ） 2003年8月1日
产品speci fi cation
www.xilinx.com
1-800-255-7778
4模块2
2
