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飞利浦半导体
SC16C550
UART具有16字节FIFO和IrDA编码器/解码器
中断使能寄存器位描述
- 续
描述
接收线状态中断。该中断会发出每当一个完全
组装接收字符从RSR传输到RHR / FIFO ，
即，数据准备，LSR [0]。
逻辑0 =禁用接收器线路状态中断（正常默认
条件）。
逻辑1 =使能接收线路状态中断。
表9 ：
位
2
符号
IER[2]
1
IER[1]
发送保持寄存器中断。该中断将随时发出
THR是空的，并与LSR [1]相关联。
逻辑0 =禁用发送器空中断（正常默认
条件）。
逻辑1 =使能发送器空中断。
0
IER[0]
接收保持寄存器中断。该中断时会发出的
FIFO已达到设定的触发电平，或者被清除时，
FIFO低于操作的FIFO模式下触发电平。
逻辑0 =禁用接收就绪中断（正常默认条件） 。
逻辑1 =使能接收就绪中断。
7.2.1
IER与接收FIFO中断模式运行
当接收FIFO （ FCR [ 0] =逻辑1） ，并且接收中断（ IER [ 0] =逻辑1）
启用时，接收中断和寄存器状态将重新FL ECT以下几点：
接收可用的中断被发布到外部CPU的数据时
FIFO已达到设定的触发电平。这将被清除时， FIFO
低于设定的触发电平。
FIFO的状态也将反映到用户访问的ISR寄存器时，
FIFO触发电平为止。无论是ISR寄存器的状态位和中断
当FIFO低于触发电平被清除。
数据就绪位（ LSR [ 0]） ，只要一个字符被从传送设
移位寄存器的接收FIFO 。这是复位时， FIFO为空。
7.2.2
IER与接收/发送FIFO查询模式操作
当FCR [0] =逻辑1 ，复位IER [ 0-3]使SC16C550在FIFO查询
操作模式。由于接收器和发送器具有单独的位在LSR中，
任一个或两者可以通过选择相应的发射被用于在轮询模式或
接收控制位（S ） 。
LSR [0]将是逻辑1，只要是在接收FIFO中的一个字节。
LSR [1-4]将提供错误的遭遇，类型（如果有） 。
LSR [5]将显示当发送FIFO为空。
LSR [6]将显示当两个发送FIFO和发送移位寄存器的
空。
LSR [7]将指示任何FIFO中的数据错误。
9397 750 11619
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产品数据
牧师05 - 2003年6月19日
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