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2005年9月
修订版0.5
3.3V零延迟缓冲器
特点
零输入 - 输出传输延迟，可调
通过FBK输入电容负载。
多种配置 - 请参阅“ ASM5P2304B
配置表“ 。
输入频率范围： 4MHz至20MHz的
多个低抖动输出。
输出输出偏斜小于200PS 。
装置设备偏斜小于500PS 。
两家银行的四路输出。
比200PS周期到周期抖动少
(-1, -1H, -2, -2H).
提供节省空间的8引脚150密耳SOIC
封装。
工作电压为3.3V 。
先进的0.35μ CMOS技术。
提供工业级温度
.
ASM5P2304B
有一个片上PLL ，其锁定到输入时钟，
呈现在REF引脚。 PLL反馈要求
被驱动至FBK销，并且可以从所述一个获得
输出。
该
输入 - 输出
传播
延迟
is
保证是小于250PS ，并且输出到输出
歪斜是保证是小于200PS 。
该ASM5P2304B有每两个输出两个银行。
多个ASM5P2304B设备能够接受相同的输入
时钟和分发。在这种情况下的偏斜
两个装置的输出被保证是小于
500pS.
该
ASM5P2304B
is
可用的
in
两
不同
配置（请参阅“ ASM5P2304B配置表） 。
该ASM5P2304B -1是基础部件，其中所述输出
频率等于参考，如果有，在无反
反馈路径。该ASM5P2304B - 1H是高驱动
此设备上的版本的-1，上升和下降时间
快得多。该ASM5P2304B -2允许用户
获得REF和1 / 2X 2X或频率上的每个输出
银行。的确切配置和输出频率
取决于其输出驱动反馈引脚。
快速
钟
in
PC ，
功能说明
ASM5P2304B是一种多功能， 3.3V零延迟缓冲器
设计
to
DISTRIBUTE
工作站，数据通信，电信和其他高性能
应用程序。它采用8引脚封装。部分
框图
FBK
CLKA1
REF
PLL
CLKA2
/2
额外的除法（-2 ）
CLKB1
CLKB2
半导体联盟
2575奥古斯丁驱动器
加利福尼亚州圣克拉拉
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