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2005年9月
1.4版
3.3V零延迟缓冲器
特点
零输入 - 输出传输延迟,可调
通过FBK输入电容负载。
多种配置 - 请参阅“ ASM5P2304A
配置表“ 。
输入频率范围: 15MHz至133MHz的
多个低抖动输出。
输出输出偏斜小于200PS 。
装置设备偏斜小于500PS 。
两家银行的四路输出。
比200PS周期到周期抖动少
(-1, -1H, -2, -2H).
提供节省空间的8引脚150密耳SOIC
包。
工作电压为3.3V 。
高级0.35< CMOS技术。
提供工业级温度。
ASM5P2304A
REF引脚。是必需的PLL反馈而被驱动以
FBK销,并且可以从输出中的一个来获得。该
输入到输出的传播延迟被保证是少
比250PS ,输出到输出歪斜是保证
小于200PS 。
该ASM5P2304A有每两个输出两个银行。
多个ASM5P2304A设备能够接受相同的输入
时钟和分发。在这种情况下的偏斜
两个装置的输出被保证是小于
500pS.
ASM5P2304A
is
可用的
in
不同
配置(请参阅“ ASM5P2304A配置表) 。
该ASM5P2304A -1是基础部件,其中所述输出
频率等于参考,如果有,在无反
反馈路径。该ASM5P2304A - 1H是高驱动
此设备上的版本的-1,上升和下降时间
快得多。
该ASM5P2304A -2允许用户获得REF和
1 / 2X 2X或频率上的每个输出库。确切的
配置和输出频率取决于其
输出驱动器的反馈引脚。
功能说明
ASM5P2304A是一种多功能, 3.3V零延迟缓冲器
设计
to
DISTRIBUTE
快速
in
PC ,
工作站,数据通信,电信和其他高性能
应用程序。这是8引脚封装。该部分有
片上PLL用于锁定到输入时钟上呈现
框图
FBK
CLKA1
REF
PLL
CLKA2
/2
额外的除法(-2 )
CLKB1
CLKB2
半导体联盟
2575奥古斯丁驱动器
加利福尼亚州圣克拉拉
联系电话: 408.855.4900
传真: 408.855.4999
www.alsc.com
注意:本文档中的信息如有更改,恕不另行通知。
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