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2功能描述
2.1设备功能
2.1.1
工作频率
由主通信的频率表示的采样频率是从主时钟产生的
（ MCLK）输入用下面的等式：
FS =采样（转换）频率= MCLK / （ 256
×
N), N = 1, 2..., 32
采样频率的倒数是两个连续的主帧同步的下降沿之间的时间
信号。这一次是在转换期。例如，要设置的转换速率为8 kHz ， MCLK = 256
×
N
×
8000.
注： N的值是在控制寄存器2和上电值定义为32 。
2.1.2
ADC信道
这两个IN（ INP ， INM ）和AUX （ AURXFP ， AURXM ）输入可以使用内置的抗混叠滤波器，可以绕过
通过写
1
到控制寄存器的位D5 1. AUX输入也可以连接到通用放大器
A 1为通用应用，例如驻极体话筒接口和2至4线混合接口，通过
写
1
为控制寄存器的IN或AUX之间的控制寄存器1选择ADC的1位D4位D6 。该
选定的输入信号是由在PGA放大，并施加到ADC的输入。 ADC上的信号转换成
离散输出的二进制补数据格式的数字字，对应于采样的模拟信号的值
时间。这些16位（或15位）的数字字，PGA后的模拟输入信号的采样值，是
同步输出的串行端口（ DOUT）在SCLK的帧同步（ FS）的间隔期间的正边缘的速率
每个位对应一个SCLK和每个主通信的一个字。在二次通信中，数据
预先编程到寄存器可以读出。如果不需要寄存器读取，全部16位清零
0在二次通信。这个读操作是通过发送相应的寄存器地址完成
（ D11 - D9）与读取位（ D12）设置为1本次通信过程中。定时序列示
在图2-1和图2-2所示。
抽取FIR滤波器可以通过编写一个可以绕过
1
为控制寄存器1。全ADC可道位D2
可以通过写入关闭以节省功耗
01
比特D2和控制寄存器D1 3 。
0
SCLK
1
……
16个SCLK
15
16
FS
……
D15
最高位
D14
DOUT
(16-bit)
……
……
D1
D0
最低位
DOUT
(15+1-bit)
D15
D14
D1
M / S
最低位
最高位
注：A。 M / S来表示15位的数据是否来自一个主机或从机设备（主：M / S = 1 ，奴隶：M / S = 0 ） 。
B的最高有效位（ D15 ）是稳定的（主机可以在此时锁存器中的数据），在SCLK的编号0的下降沿磨边;最后位（D0， M / S）
是稳定的，在SCLK的号码15的落下磨边。
图2-1 。 ADC通道的时序（仅主通信）
2–1
