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AD7475/AD7495
该部分电路进入
部分掉电
CS
1
SCLK
2
10
16
1
2
10
16
的部分开始
上电
该部分电路进入
完全掉电
SDATA
无效数据
三态
无效数据
三态
图16.进入完全关断模式
的部分开始
上电
零件完全
电
t
上电
CS
1
SCLK
10
16
1
16
SDATA
无效数据
有效数据
图17.退出完全关断模式
16个SCLK周期必须经过上电设备
充分掌握V
IN
; 1
s
将足以为设备供电
向上和获取输入信号。如果，例如，一个5兆赫的SCLK
频率施加到ADC ，周期时间是3.2秒。
在一个空周期， 3.2
s,
的部分将被通电并
V
IN
全面收购。然而，经过1
s
用5 MHz的SCLK，
只有5个SCLK周期将结束。在这个阶段中，ADC
将完全加电和信号获取。所以，在此
情况下，
CS
第十个SCLK下降沿之后，可以带来高
并经过时间t拉低再次
安静
来启动转换。
完全关断模式
只要
CS
保持低电平，直到十的下降沿后
SCLK 。在上电时间长于1虚设转换
但是周期，而这一次，T
上电
之前，必须经过
转换可以启动，如图17 （见
时序规范要求。 ）
当电源被首先应用到AD7475 / AD7495 ，
该ADC可无论是在掉电模式下的电或
正常模式。因为这一点，最好是使一个空周期
要经过以确保零件完全加电之前attempt-
荷兰国际集团的有效转换。同样，如果想要保持部
在部分掉电模式立即用品后
被施加，那么两个伪循环必须被初始化。第一
空周期必须持有
CS
为低电平，直到第十个SCLK后
下降沿，图13 ;在第二周期
CS
必须使
第十个SCLK上升沿之前，但第二个SCLK后高
下降沿，如图14或者，如果它被用于把
该部分完全关断模式下，当电源已
施加的，那么三个虚拟周期必须被初始化。第一
空周期必须持有
CS
为低电平，直到第十个SCLK后
边缘，如图13 ;在第二和第三伪周期发生的
在完全关断部分，如图操作16.查看模式
部分。一旦电源被施加到AD7475 / AD7495 ，
足够的时间必须被允许，对于AD7475 ，对于外部
参考电和参考电容器充电到其
最终值。对于AD7495 ，有足够的时间，应允许
内部基准电压缓冲到基准电容器充电。
然后，以将AD7475 / AD7495在正常模式下，虚设
周期， 1
s,
应开始。如果第一有效转换，然后
直接虚设变换后进行，但必须是
为确保有足够的采集时间已被允许。
如前面提到的，从掉电通电时
模式下，部分将归到第一SCLK边缘追踪
的下降沿之后施加
CS 。
然而，当ADC
上电时施加用品最初后，轨道和保持
将已经在轨道上。这意味着（假定1具有的制造厂
性监控ADC的电源电流） ，如果ADC上电
REV 。一
此模式适用于在应用中使用慢
吞吐速率要求高于局部断电
方式，如从一个完全关断功率可达不会的COM
完整的只是一个虚拟的转换。这种模式更适合于
其中，在相对执行一系列的转换应用
高吞吐速率之后将长时间的
不活动，从而省电。当AD7475 / AD7495
在全功率下，所有模拟电路断电。
完全掉电输入的方式类似，局部断电，
除了在图14所示的时序必须被执行
两次。转换过程中，必须在一个类似被中断
时尚通过将
CS
第二次下跌后的任何地方高
SCLK和SCLK的第十个下降沿之前的边缘。该
器件将进入此时局部断电。为了达到全
断电，在下一个转换周期必须中断
以同样的方式，如图16一旦
CS
已
在SCLK周期的窗口，带来了高的话，一部分会
完全断电。
注意：这是没有必要的，完成16个SCLK一次
CS
已经带来了较高的进入掉电模式。
要退出完全关断，以及电源AD7475 / AD7495起来
再次，一个虚拟的转换何时完成供电
从局部断电。上的下降沿
CS
该
设备将开始通电，并继续向上的动力
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