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DDR SDRAM 128Mb的F-模（ X4，X8 ）
主要特点
双数据速率体系结构;每个时钟周期2的数据传输
双向数据选通（ DQS ）
四家银行的操作
差分时钟输入（ CK和CK ）
DLL对齐DQ和DQS与CK过渡转型
MRS循环地址重点项目
- 。读取延迟2 ， 2.5 （时钟）
- 。突发长度（ 2，4， 8）
- 。突发类型（顺序&交错）
除数据& DM所有输入进行采样，系统时钟的正边沿（CK）
数据I /数据选通信号的两边O事务
边沿对齐的数据输出，居中对齐数据输入
DM为只写屏蔽（ X4，X8 ）
自动&自我刷新
15.6us刷新间隔（ 4K / 64ms的刷新）
最大连拍数量刷新周期： 8
66pin TSOP II封装
DDR SDRAM
订购信息
产品型号
K4H280438F-TC/LA2
K4H280438F-TC/LB0
K4H280438F-TC/LA0
K4H280838F-TC/LB3
K4H280838F-TC/LA2
K4H280838F-TC/LB0
16M ×8
32M ×4
组织。
最大频率。
A2(DDR266@CL=2)
B0(DDR266@CL=2.5)
A0(DDR200@CL=2)
B3(DDR333@CL=2.5)
A2(DDR266@CL=2)
B0(DDR266@CL=2.5)
SSTL2
66pin TSOP II
SSTL2
66pin TSOP II
接口
包
工作频率
B3(DDR333@CL=2.5)
速度@ CL2
速度@ CL2.5
* CL ： CAS延迟
133MHz
166MHz
A2(DDR266@CL=2.0)
133MHz
133MHz
B0(DDR266@CL=2.5)
100MHz
133MHz
A0(DDR200@CL=2.0)
100MHz
-
修订版1.1月。 2004年
