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DDR SDRAM （ Rev.1.0 ）
七月'01
初步
三菱的LSI
M2S56D20 / 30 / 40AKT
256 MD ouble ATA 吃了S ynchronous DRAM
框图
DLL
DQ0 - 15
UDQS ， LDQS
I / O缓冲器
QS缓冲区
内存
ARRAY
银行＃ 0
内存
ARRAY
银行＃ 1
内存
ARRAY
银行＃ 2
内存
ARRAY
银行＃ 3
模式寄存器
控制电路
地址缓冲器
时钟缓冲器
A 0-12
BA0,1
C L K / C L K C的K E特征
/ CS
控制信号缓冲
/ RAS / CAS
/ WE
UDM ，
LDM
型号代码
此规则仅应用于同步DRAM的家庭。
M 2第56 3 0 A TP -75A
速度等级
10 ： 125兆赫@ CL = 2.5,100MHz @ CL = 2.0
75:
133兆赫@ CL = 2.5,100MHz @ CL = 2.0
75答：为133MHz @ CL = 2.5,133MHz @ CL = 2.0
封装类型TP ： TSOP （ II ）
程世代
功能保留供以后使用
n
组织2
2: x4, 3: x8, 4: x16
DR同步DRAM
密度56 ： 256M位
接口
V ： LVTTL ，S ： SSTL_3 ， _2
内存式（ DRAM ）
三菱主名称
三菱电机
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