飞思卡尔半导体公司
特点
- 每个PHY可选统计细胞计数器
- 与加入的FIFO缓冲UTOPIA第2等级兼容接口，以减少总的细胞
传输时间。 （早期的乌托邦水平1特定网络阳离子也支持。 ）
- 在MPC857T多PHY支持
- 对MPC857DSL四PHY支持
- 参数RAM为SPI和I
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C能没有基于RAM的微搬迁
- 支持使用全双工UTOPIA两个主（ ATM侧）和从器件（ PHY端）操作
“分裂”的公交车
- AAL2 / VBR功能ROM驻留
达32位的数据总线（动态母线调整为8 ，16，和32位）
32条地址线
内存控制器（八家银行）
- 包含完整的动态RAM （ DRAM ）控制器
- 每个银行可以是一个片选或RAS支持DRAM银行
- 最多30个等待状态每个存储器组编程
- 无缝接口页面模式/ EDO / SDRAM，SRAM， EPROM中，佛罗里达州灰的EPROM ，和其它
存储器装置。
- DRAM控制器，可编程，支持大多数的大小和高速存储器接口
- 中科院四线，四WE线，一条线OE
- 开机复位芯片选择（用于8位，16位或32位内存选项）
- 可变块大小（ 32字节， 256兆字节）
- 可选择写保护
- 片上总线仲裁逻辑
通用定时器
- 4个16位定时器级联是两个32位定时器
- 门模式下可以启用/禁用计数
- 中断可以在基准匹配和事件捕获屏蔽
快速以太网控制器（ FEC ）
- 使用UTOPIA时同时MII （ 10 / 100BASE - T）和UTOPIA操作
多路公交车。
系统集成单元（ SIU ）
- 公交车监控
- 软件看门狗
- 周期性中断定时器（ PIT ）
- 低功耗停止模式
时钟合成器
- 递减器，时基和实时从PowerPC架构时钟（ RTC ）
- 复位控制器
- IEEE 1149.1测试访问端口（JTAG）
中断
- 七外部中断请求（ IRQ ）线路
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摩托罗拉
MPC862 / 857T / 857DSL硬件特定网络阳离子
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