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飞思卡尔半导体公司
电气和热特性
3.2.4 G2_LE核心PLL电气特性
该G2_LE芯的内部时钟是从产生并借助于同步到系统时钟
的电压控制核心的PLL 。
表11 G2_LE PLL规格
特征
G2_LE频率
G2_LE周期时间
G2_LE VCO频率
G2_LE输入时钟频率
符号
f
CORE
t
CORE
f
VCOcore
f
系统时钟
t
系统时钟
t
抖动
t
LOCK
2
3
笔记
1
1
1
民
50
2.85
400
25
2.73
—
—
典型
—
—
—
—
—
—
—
最大
550
40.0
1200
367
50.0
150
100
单位
兆赫
ns
兆赫
兆赫
ns
ps
s
SpecID
O4.1
O4.2
O4.3
O4.4
O4.5
O4.6
O4.7
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G2_LE输入时钟周期时间
G2_LE输入时钟抖动
G2_LE PLL重新锁定时间
1
2
3
SYSCLK的频率和G2_LE PLL配置位必须被选择，使得所得到的系统的频率，
的CPU （核心）频率，和G2_LE锁相环（VCO）的频率不超过各自的最大或最小能操作
阿婷频率。
这代表总输入抖动 - 短期和长期相结合 - 并通过设计保证。两种不同类型的
抖动可以存在于输入到core_sysclk ，系统性和真随机抖动。真正的随机抖动被拒绝，但PLL 。
全身抖动将被传递进入并通过PLL来的内部时钟电路，直接还原的操作频
昆西。
这段时间内通过设计和特性保证。需要PLL -这段时间内的最大时间量
一个稳定的Vdd和core_sysclk之后PLL锁定在上电复位序列期间达成。此规范
也适用于当PLL已被禁用，并随后在睡眠模式下重新启用。
14
MPC5200硬件规格
摩托罗拉
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