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40MX和42MX FPGA系列
表29
A40MX02时序特性（标称值为3.3V操作） （续）
（最坏情况下的商业条件，V
CC
= 3.0V ，T
J
= 70°C)
' -3 '速度
'-2 '速度
“-1”速度
“标准”速度
“ -F ”速度
参数说明
CMOS输出模块时序
4
t
DLH
t
DHL
t
ENZH
t
ENZL
t
ENHZ
t
ENLZ
d
TLH
d
THL
注意事项：
数据 - 垫高
数据对垫低
启用垫Z到高
启用垫Z到低
启用垫高到Z
启用垫低到Z
三角洲低到高
台达高到低
分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。分钟。马克斯。单位
5.5
4.8
4.7
6.8
11.1
8.2
0.05
0.03
6.4
5.5
5.5
7.9
12.8
9.5
0.05
0.03
7.2
6.2
6.2
8.9
14.5
10.7
0.06
0.04
8.5
7.3
7.3
10.5
17.1
12.6
0.07
0.04
11.9
10.2
10.2
14.7
23.9
17.7
0.10
0.06
ns
ns
ns
ns
ns
ns
NS / PF
NS / PF
1.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应该被用于估计
器件的性能。布线后的时序分析或模拟需要确定实际性能。
2.设置时间假设3.进一步测试扇出的信息可以从定时程序来获得。
3.保持时间为DFME1A宏可以大于0毫微秒。从Designer软件使用定时器工具来检查货舱
时间这个宏。
4.延误基于35 pF的负载。
v6.0
1-41
