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2.15.2.2读第2阶段
STEP 7
I2C启动（主）
第8步
I2C通用地址（主）
第9步
I2C应答（从）
第10步
I2C读取数据（从站）
STEP 11
I2C无应答（主）
0
S
7
1
9
A
7
数据
9
A
6
数据
5
数据
4
数据
3
数据
2
数据
1
数据
0
数据
6
0
5
1
4
1
3
1
2
0
1
X
0
1
STEP 12
0
I2C停止（主）
P
重复步骤10和11的读取所有字节。师父不承认收到最后一次读取数据。
2.15.2.3 I
2
时序要求
该TVP5150A解码器需要在I延误
2
C访问，以适应其内部处理器的时间。在
按照我
2
C规格的TVP5150A解码器持有的我
2
时钟线（ SCL）低，表示等待
期间向我
2
C中间。如果我
2
C中间是不是要检查的我
2
时钟线保持为低时，则
最大延迟必须始终插在有需要。这些延迟是可变长度的;最大延时
在如下图所示：
普通寄存器写地址00H -的8Fh （地址为90H - FFH不需要延迟）
从机地址
(B8h)
数据
（ XXh时）
等待64
s
开始
确认
子地址
确认
确认
停止
在64微秒的延迟是为所有的寄存器，不需要重新初始化。延迟可能会更对一些寄存器。
2.16时钟电路
一个内部行锁定PLL产生的系统和像素时钟。一个14.31818 MHz的时钟需要驱动PLL 。
这可被输入到端子5（ XTAL1）的TVP5150A解码器，或14.31818 MHz的基本的晶体
谐振频率可以在端子5和6（ XTAL2 ）相连接。图2-5显示了参考时钟
配置。对于所示的例子晶体电路（并联谐振晶体与14.31818 MHz的基本
频率），则外部电容器必须具有以下关系：
C
L1
= C
L2
= 2C
L
C
杂散
,
其中C
杂散
是相对于接地端子的电容。图2-5显示了参考时钟
精读网络gurations 。
TVP5150A
5
14.31818-MHz
TTL时钟
TVP5150A
5
14.31818-MHz
水晶
CL1
XTAL1
XTAL1
XTAL2
6
XTAL2
6
CL2
图2-5 。参考时钟配置
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