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IDT 79RC32355
133MHz
参考
EDGE
最小最大
150MHz
民
最大
180MHz
民
最大
定时
条件图
参考
信号
符号
单位
内存和外设总线 - SDRAM的访问
MDATA [31 ：0]的
Tsu1
Thld1
Tdo1
Tdz1
Tzd1
MADDR [20： 2]，
BWEN [3 ：0]的
CASN ， RASN ，
SDCSN [1： 0]， SDWEN
CKENP
BDIRN
BOEN [1 ：0]的
SYSCLKP上升
SDCLKINP
Tdo2
Tdo3
Tdo4
Tdo5
Tdo6
Tdo7
Tperiod8
Thigh8,Tlow8
Trise8,Tfall8
Tdelay8
SYSCLKP
升起
SYSCLKP
升起
SYSCLKP
升起
SYSCLKP
升起
SYSCLKP
升起
SYSCLKP
升起
CLKP上升
无
SDCLKINP
升起
SYSCLKP
升起
2.5
1.5
1.2
—
1.0
1.2
1.2
1.2
1.2
1.2
0.5
15
6.0
—
0
—
—
5.8
5.0
—
5.3
5.3
5.3
5.3
5.3
5.0
50
—
3.0
4.8
2.5
1.5
1.2
—
1.0
1.2
1.2
1.2
1.2
1.2
0.5
13.3
5.4
—
0
—
—
5.8
5.0
—
5.3
5.3
5.3
5.3
5.3
5.0
50
—
2.5
4.8
2.5
1.5
1.2
—
1.0
1.2
1.2
1.2
1.2
1.2
0.5
13.3
5.4
—
0
—
—
5.8
5.0
—
5.3
5.3
5.3
5.3
5.3
5.0
50
—
2.5
4.8
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
图8
图9
图10
表6的存储器和外设总线AC时序特性（共2第1部分）
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2004年5月25日
