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LTC1272
APPLICATI
S I FOR ATIO
CS
t
1
RD
t
10
t
2
t
CONV
忙
t
3
数据
t
12
HOLD
轨道
LTC1272 TA16
旧数据
DB11-DB0
图14.慢速内存模式，并行读时序图
表2.慢速内存模式，并行读数据总线状态
数据输出
读
D11
DB11
D10
DB10
D9
DB9
D8
DB8
D7
DB7
D6
DB6
D5
DB5
D4
DB4
D3/11
DB3
D2/10
DB2
D1/9
DB1
D0/8
DB0
数据格式
输出数据格式可以是一个完整的平行
负载为16位微处理器或一个两字节的负载为
8位微处理器。数据始终是右对齐（即，
LSB是一个16位字中的最右侧的位）。对于两
字节读取，唯一的数据输出D7 。 。 。 D 0 /8被使用。字节
选择由HBEN输入，其控制的支配
内部数字多路复用器。此复用的12位的
转换数据到下D7 。 。 。 D0 / 8个输出
（ 4MSBs或8LSBs ），其中它可以读取在两个读出周期。
该4MSBs始终显示在D11 。 。 。 D8每当
三态输出驱动器导通。
缓慢的内存模式，并行读（ HBEN = LOW ）
图14和表2示出了时序图和数据
总线状态为慢速内存模式，并行读。 CS和
RD低时会触发转换和LTC1272
确认通过采取BUSY低。从前面的数据
转换出现在三态数据输出。忙
在转换时，输出的末尾返回高
锁存器已被更新和转换结果
放置在数据输出D11 。 。 。 D 0/ 8 。
U
t
5
t
1
t
11
t
6
t
7
新资料
DB11-DB0
W
U
UO
慢速内存模式下，两个字节阅读
对于两字节的读，只有8位数据输出D7 。 。 。 D0 / 8顷
使用。转换启动程序和数据输出状态
对于第一读取操作是相同的慢速存储器
模式，并行读。参见图15时序图和
表3的数据总线的状态。在转换的低的端
数据字节（ DB7 。 DB0 ）从ADC读取。第二个
读操作与HBEN高，地方上的高字节
数据输出端D 3 /11。 。 。 D0 / 8和禁用转换开始。
注意4MSBs出现在数据输出D11 。 。 。在D8
两个读操作上面。
ROM模式，并行读（ HBEN = LOW ）
该ROM模式避免了将微处理器成
等待状态。 A转换开始读操作
和从先前转换的12位数据是
可在数据输出D11 。 。 。 D 0/ 8 （参见图16和
表4）。如果不需要此数据可能会被忽略。一
第二个读操作读取新数据（ DB11 。 DB0 ）
并开始另一次转换。延迟最少只要
在LTC1272的转换时间加上1μs的最小延迟
之间的转换之间必须读允许
操作。
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