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ACEX 1K可编程逻辑器件系列数据手册
对于改进的路由，在该行互连由一个组合的
全长和半长通道。全长的通道连接到
在一排的所有实验;半身通道连接到所述LAB中一半的
该行。将EAB可以通过半长通道在左半被驱动
行的，并通过全长频道。将EAB驱逐到全
长的渠道。除了提供一个可预测的，行宽
互连，这种架构提供了增强的布线资源。两
相邻的LAB可以使用半行信道进行连接，从而
保存该信道的另一半行的另一半。
表6
总结了FastTrack网络互连路由结构
在每个ACEX 1K器件可用资源。
表6. ACEX 1K FastTrack网络互连资源
设备
EP1K10
EP1K30
EP1K50
EP1K100
排
3
6
10
12
每通道
ROW
144
216
216
312
柱
24
36
36
52
每通道
COLUMN
24
24
24
24
除了通用I / O引脚， ACEX 1K器件具有6
专用输入引脚，提供低抖动信号分布在整个
装置。这六个输入可用于全局时钟，清晰，预置和
外设输出使能和时钟使能控制信号。这些信号
可作为设备中所有LAB和IOEs控制信号。该
专用输入，也可以用作通用的数据输入，因为
他们可以在设备养活每个LAB的局部互连。
图14
显示相邻LAB和EABS的互联，与
行，列，和局部互连，以及相关联的级联
和进位链。每个LAB是根据它的位置标记为：信
表示行和若干表示列。例如，
LAB B3是B行，第3列。
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Altera公司。
