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掉电模式
该ATF22V10C包括一个可选引脚控制的关断功能。当此
模式被激活时, PD引脚用作掉电引脚(引脚4上的DIP / SOIC封装
年龄和引脚5上的PLCC封装) 。当PD引脚为高电平时,器件供应
电流减小到小于100毫安。在掉电期间,所有输出数据和内部
逻辑状态被锁存,并举行。因此,所有注册和组合输出数据
仍然有效。这是处于不确定的状态,在加电的发病任何输出
下将保持在相同的状态。在掉电期间,除了所有的输入信号
掉电引脚被阻止。输入和I / O锁存器保持保持活跃,以确保
引脚不浮动不确定的水平,进一步降低了系统功耗。上电
断引脚功能在逻辑设计文件中启用。使用掉电销设计
不得使用PD引脚的逻辑阵列的输入。然而,所有其他的PD引脚宏蜂窝资源
仍然可以使用,包括掩埋反馈和折返乘积项阵列的输入。
PD引脚配置由设计文件控制,并显示为一个单独的保险丝位
在JEDEC文件。当在设计文件中未指定的省电特性,则
IN / PD引脚将被配置为常规逻辑输入。
注意:
有些程序员列出22V10 JEDEC兼容22V10C (不使用PD )分别
从非22V10 JEDEC兼容22V10CEX (帕金森氏病中使用) 。
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ATF22V10C(Q)
0735P–PLD–01/02

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