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COP8SG家庭
5.0功能描述
该器件的架构是一种改进型哈佛AR-
民族形式。与哈佛结构，程序
存储器ROM被从数据存储存储器中分离
（内存） 。 ROM和RAM有自己独立的AD-
更衣室的空间有独立的地址总线。该architec-
TURE ，但基于哈佛架构，许可证
从ROM中的数据传送到RAM 。
5.1 CPU寄存器
CPU可以做一个8位的加法，减法，逻辑或移位
在一个指令的操作（叔
C
）的周期时间。
有六种CPU寄存器：
A是8位累加寄存器
PC是15位的程序计数器寄存器
聚氨酯是高7位程序计数器（PC）的
PL为低8位程序计数器（PC）的
B是一个8位RAM地址的指针，其可以是任选
后自动递增或递减。
X是一个8位的备用RAM的地址指针，它可以是
可选择发布自动递增或递减。
S是用于扩展的8位段地址寄存器
的地址范围的下半部分（00至7F）成256个数据
每128字节段。
SP为8位的堆栈指针，它指向的子程序/
中断堆栈（ RAM中） 。带复位的SP被初始化
RAM地址02F十六进制（以64字节的RAM的设备） ，或
初始化到RAM地址06F十六进制（器件具有128字节
的RAM）中。
所有的CPU寄存器的内存映射的例外
化的累加器（ A）和程序计数器（ PC）中。
5.2程序存储器
程序存储器ROM组成不同而异尺寸。
这些字节可以存放程序指令或数据常量
（数据表下岗指令，跳到载体的JID
对于VIS指令的指令，并中断向量） 。该
程序存储器是由15位解决方案
计数器（PC） 。在设备的所有向量中断编程
内存位置0FF十六进制。该节目的内容
存储器读出00进制中的已擦除状态。程序执行
复位后开始在位置0 。
5.3数据存储器
该数据存储器的地址空间包括片上RAM
和数据寄存器， I / O寄存器（配置，数据和
脚），控制寄存器， MICROWIRE / PLUS SIO移位
注册和各种寄存器和计数器相关
与计时器（除IDLE计时器的） 。数据
存储器由指令或间接直接寻址
由B，X和SP指针。
该数据存储器包括256个或512个字节的RAM。
十六个字节的RAM ，在AD-被映射为“登记”
礼服0F0到0FE十六进制。这些寄存器可以被加载
立即，并且也降低，并且与测试
DRSZ （递减寄存器则跳过零）指令。该
内存指针寄存器X， SP和B内存映射
进入这个空间的地址位置0FC到0FE六角respec-
疑心，与其他寄存器（除0FF ）是可用的
一般用法。
该指令集的许可证被设置在内存中的任何位，复位
或测试。所有的I / O和寄存器（除A和PC ）是
内存映射;因此， I / O位和寄存器位可以是
直接地和单独地设定，复位和测试。把累加器
荡器（A ）位，也可以直接和单独测试。
注意：
上电时RAM的内容是不确定的。
5.4数据存储段夯扩
数据存储器地址0FF被用作映射内存
位置的数据段地址寄存器（S） 。
数据存储存储器或者直接通过一个寻址
指令中的单字节地址，或间接厘清
略去对B，X，或SP指针的引用（每
包含单个字节的地址） 。此单字节地址
允许256个地址从00到FF的寻址范围
（十六进制） 。此单字节地址的高位比特分割
数据存储存储器分成两个独立的部分所概述
以前。除了在RAM寄存器中存储的
从地址位置00F0到00FF ，所有的RAM内存
存储器映射与单字节AD-的上端位
穿着等于零。这允许将所述高位比特
单字节地址，以确定是否将基
地址范围（从0000到00FF ）扩展。如果这上
位等于1 （表示地址范围0080至00FF ）
那么地址扩展不会发生。可选地，如果
这高位比特等于零，则该数据段的扩展
寄存器S被用于扩展的基地址范围（从
0000 007F ）从XX00到XX7F ，其中XX代表
8位来自S寄存器。因此， 128字节的数据段
扩展位于从地址0100至017F的
数据段1中， 0200至027F为数据段2中，等等，达到
FF00至FF7F为数据段255，基地址
范围从0000到007F表示数据段的0 。
图7
说明了如何在S寄存器数据存储器exten-
锡永用于延伸的基础地址的下半部分
范围（00 7F十六进制）到128字节的256个数据段
每一个，与来自XX00 32 KB的总寻址范围
到XX7F 。这种组织允许总共256个数据段
的每128个字节，一个额外的上基部ments
段的128个字节。此外，所有的寻址方式
可用于所有的数据段。在S寄存器必须是
程序的控制下改变，从一个数据移动
段（ 128字节）到另一个。然而，上基
段（含16个内存寄存器，I / O寄存器，
控制寄存器等），总是可以不管
在S寄存器的内容时，由于上部底座段
（地址范围0080至00FF ）是独立的数据段的
换货扩展。
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