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为
为
的enCoRe
USB
CY7C63221/31A
19.2
中断延迟
中断等待时间可从下式计算：
+ （ 10个时钟周期为CALL指令）中断延迟= （剩余在当前指令的时钟周期数） +
（ 5个时钟周期为JMP指令）
例如，如果有5个时钟周期的指令比如JC正在发生中断时，对所述第一指令执行
中断服务程序将执行至少16个时钟周期（ 1 + 10 + 5）或中断后，最多不超过20个时钟周期（ 5 + 10 + 5 ）
发出。随着6 MHz的外部振荡器，内部CPU时钟速度为12兆赫，因此20个时钟走20/12兆赫= 1.67
s.
19.3
中断源
以下各节提供了不同类型的中断源的详细信息。
位＃
位名称
7
WAKE -UP
打断
启用
读/写
0
6
GPIO
打断
启用
读/写
0
-
0
5
4
版权所有
3
2
1.024-ms
打断
启用
-
0
读/写
0
1
128-s
打断
启用
读/写
0
0
USB总线
复位/
PS / 2活性
INTR 。启用
读/写
0
读/写
RESET
-
0
图19-1 。全局中断使能寄存器（地址0x20的）
第7位：唤醒中断使能
内部唤醒定时器通常用于唤醒部从暂停模式，但它也可以提供一个中断时
该部分是清醒的。唤醒定时器清零每当唤醒中断允许位被写入0 ，并且运行时
该位被写入1，当中断使能时，唤醒定时器提供周期性的中断，在一段倍数，
在第11.2节所述。
1 =使能唤醒定时器周期性唤醒。
0 =禁用和断电唤醒定时器。
第6位： GPIO中断使能
每个GPIO引脚作为中断输入。在复位时， GPIO中断通过清除所有GPIO中断禁止
使能寄存器。写“1”到GPIO中断使能位使能相应的输入引脚GPIO中断。这些
寄存器示于
图19-4
对于端口0和
图19-5
港口1.除启用所需的各个引脚
中断，主GPIO中断使能，如第19.0解释。
触发中断的极性为每个GPIO管脚由GPIO中断极性寄存器独立控制。
设置一个极性位为“0”允许在一个下降沿的GPIO边沿产生中断，同时设定了极性位为“1”允许在一个中断
上升GPIO边缘。该极性寄存器复位为0，显示在
图19-6
对于端口0和
图19-7
端口1 。
所有的GPIO引脚共享一个中断向量，这意味着该固件将需要读出的GPIO端口与启用
中断，以确定哪些销或销引起的interrupt.The GPIO的中断结构示于
图19-8 。
需要注意的是，如果一个端口引脚触发中断，没有其他的端口引脚可引起GPIO的中断，直到该端口引脚返回
为无效（非触发）状态或对应端口的中断使能位被清零。在CY7C63221 / 31A不分配
中断优先级不同的端口引脚和端口中断使能寄存器不受中断响应
流程。
1 =启用
0 =禁用
位[5： 3]：
版权所有
第2位： 1.024毫秒的中断使能
在1.024毫秒的中断是从自由运行定时器（基于6 - MHz时钟）周期定时器中断。用户应
之前进入挂起模式，以避免在维修定时器中断之间可能发生的冲突禁用该中断
（ 128 μs的中断和1.024毫秒中断）第一或醒来时，第一个挂起请求。
1 =启用。周期性的中断将产生大约每1.024毫秒。
0 =禁用。
文件编号： 38-08028修订版**
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