初步
Am29040
高性能RISC微处理器
与指令和数据缓存
特色鲜明
完整的32位架构
66.8 VAX MIPS维持在50兆赫
4K字节， 2路组相联高速缓存中的数据
8字节， 2路组相联指令
缓存
两个周期的32位乘法器的快速整数
数学;三周期乘法累加（ MAC ）
功能
32进入片上内存管理单元
采用双转换后备缓冲器
多处理器支持
外部总线上与指令/数据的奇偶校验
MMU控制奇偶校验页面上的基础
在页面的基础数据高速缓存控制
MMU的可编程的16位或32位的数据总线
宽度的页面的基础
精简的系统界面简单，
高频率运行
33- ， 40-和50 - MHz的CPU工作频率
可扩展的时钟功能
可选的时钟倍频
用于数字延迟锁定环（DLL）的特征
精确的时钟控制
先进
微
器件
与5 -V容错我3.3 V操作/ O
低功耗贪睡模式和休眠模式
完全静态
8位，16位或32位ROM接口
突发模式和页模式访问支持
引脚和总线兼容Am29030 和
Am29035 微处理器
所有29K 系列的二进制兼容性
微处理器和微控制器
CMOS技术/ TTL兼容
192个通用寄存器
完全流水线
三地址指令架构
4 GB的需求的虚拟地址空间
分页
片上定时器设备
硬件指令和数据断点
先进的调试支持
可追溯的缓存指令和数据高速缓存
跟踪功能
IEEE标准1149.1-1990 （ JTAG ）标准
标准测试访问端口和边界扫描
架构的实施
Am29040微处理器框图
Am29000
R
中央处理器
32 ×32乘法器
MMU
ADDR
INST
数据
8-Kbyte
指令缓存
（ 2x1Kx32 ）位
4-Kbyte
数据缓存
（ 2x512x32 ）位
ADDR
研究所/数据
出版＃
18459
启示录
B
修订
/0
发行日期：
1995年6月WWW ： 95年6月7日
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