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WM8971L
电源管理
先进的信息
该WM8971L具有两个控制寄存器，允许用户选择哪个功能是活动的。为
最低功耗，未使用的功能，应禁用。为了避免任何弹出或点击噪音，
启用或禁用以正确的顺序功能（参见应用信息）是重要的。
VMIDSEL是启用vmid的参考，默认为禁用，可启用为
50kOhm分压器或者，对于低功率保持Vref，而当所有的其他块被禁用时，
作为500kOhm分压器。
注册
地址
R25 （ 19H）
动力
管理
(1)
位
8:7
LABEL
VMIDSEL
默认
00
描述
VMID分频器启用和选择
00 = VMID禁用（为OFF模式）
01 - 50kOhm分频器使能（为
播放/记录）
10 - 500kOhm分频器使能（低功耗
待机）
11 - 5kOhm分启用（快速启动）
VREF （必需的所有其他功能）
模拟在PGA左
模拟在PGA权
ADC左
ADC RIGHT
MICBIAS
DAC LEFT
DAC RIGHT
LOUT1输出缓冲区*
ROUT1输出缓冲区*
LOUT2输出缓冲区*
ROUT2输出缓冲器*
MONOOUT输出缓冲器和单声道混音器
6
5
4
3
2
1
R26 （为1Ah ）
动力
管理
(2)
8
7
6
5
4
3
2
VREF
AINL
AINR
ADCL
ADCR
MICB
DACL
DACR
LOUT1
ROUT1
LOUT2
ROUT2
单声道
0
0
0
0
0
0
0
0
0
0
0
0
0
注意：
所有控制位0 =关， 1 =开
*左混频器时启用LOUT1 = 1或LOUT2 = 1 。正确的混频器时启用
ROUT1 = 1或ROUT2 = 1 。
表36电源管理
停止主时钟
为了最小化功率消耗的WM8971L的数字核心，主时钟应
停在待机和关机模式。如果这是不能在时钟源外部完成，则
DIGENB位（ R 25 ，位0）可被设置为蔓延至所述设备核心停止MCLK信号。在
待机模式下，所有的供应电压为3.3V ，设定DIGENB节省约0.27毫安上DCVDD
和0.2毫安上DBVDD 。然而，由于设置DIGENB对的功耗没有影响
外部的WM8971L其他系统部件，优选禁用主时钟，其
来源尽可能。
注册
地址
R25 （ 19H）
额外的控制
(1)
1
位
LABEL
DIGENB
0
默认
描述
主时钟禁用
0 ：主时钟启用
1 ：主时钟禁用
表37 ADC和DAC过采样速率选择
注意：
前DIGENB可设定，控制位ADCL ， ADCR， DACL和DACR必须设置为
零和1毫秒的等待时间必须得到遵守。任何不遵守这一程序可能会阻止
DAC和ADC无法正常重新启动。
w
AI版本3.0 2004年3月
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