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54SX系列FPGA
有5 4 SX 3 2 T的即时消息建华AR交流TE ristics
（最坏情况下的商业条件，V
CCR
= 4.75V, V
CCA ，
V
CCI
= 3.0V ，T
J
= 70°C)
' -3 '速度
参数
描述
分钟。
马克斯。
'-2 '速度
分钟。
马克斯。
“-1”速度
分钟。
马克斯。
“标准”速度
分钟。
马克斯。
单位
C-细胞传播延迟
1
t
PD
内置阵列模块
0.6
0.7
0.8
0.9
ns
预测布线延迟
2
t
DC
t
FC
t
RD1
t
RD2
t
RD3
t
RD4
t
RD8
t
RD12
FO = 1路由延迟，直连
FO = 1路由延迟，快速连接
FO = 1路由延迟
FO = 2路由延迟
FO = 3路由延迟
FO = 4路由延迟
FO = 8路由延迟
FO = 12路由延迟
0.1
0.3
0.3
0.7
1.0
1.4
2.7
4.0
0.1
0.4
0.4
0.8
1.2
1.6
3.1
4.7
0.1
0.4
0.4
0.9
1.4
1.8
3.5
5.3
0.1
0.5
0.5
1.0
1.6
2.1
4.1
6.2
ns
ns
ns
ns
ns
ns
ns
ns
R-小区定时
t
RCO
t
CLR
t
预设
t
SUD
t
HD
t
WASYN
连续时钟到Q
异步清除到Q的
异步预置到Q
触发器的数据输入建立
触发器的数据输入保持
异步脉冲宽度
0.5
0.0
1.4
0.8
0.5
0.7
0.6
0.0
1.6
1.1
0.6
0.8
0.7
0.0
1.8
1.3
0.7
0.9
0.8
0.0
2.1
1.4
0.8
1.0
ns
ns
ns
ns
ns
ns
输入模块传输延迟
t
INYH
t
INYL
输入数据垫到-Y高
输入数据垫到-Y LOW
1.5
1.5
1.7
1.7
1.9
1.9
2.2
2.2
ns
ns
预测输入路由延迟
2
t
IRD1
t
IRD2
t
IRD3
t
IRD4
t
IRD8
t
IRD12
FO = 1路由延迟
FO = 2路由延迟
FO = 3路由延迟
FO = 4路由延迟
FO = 8路由延迟
FO = 12路由延迟
0.3
0.7
1.0
1.4
2.7
4.0
0.4
0.8
1.2
1.6
3.1
4.7
0.4
0.9
1.4
1.8
3.5
5.3
0.5
1.0
1.6
2.1
4.1
6.2
ns
ns
ns
ns
ns
ns
注意事项：
1.对于双宏模块，使用吨
PD
+ t
RD1
+ t
PDN
, t
RCO
+ t
RD1
+ t
PDN
或T
PD1
+ t
RD1
+ t
SUD
，适当的指令。
2.路由延迟对于典型设计跨最坏情况下的运行工况。这些参数应被用于估计装置
性能。布线后的时序分析或模拟需要确定实际的最坏情况下的性能。布线后时序
基于在装运之前在设备上执行实际的路由延迟的测量。
32
v3.1
