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54SX系列FPGA
P I N D E S·C R I P TI 0：N
CLKA / B
时钟A和B
TCK
测试时钟
这些引脚3.3V / 5.0V PCI / TTL时钟输入时钟
分销网络。的时钟输入之前缓冲
时钟的R单元。如果不使用，该引脚必须设为低或
高在黑板上。它不能悬空。 （对于
A54SX72A ，这些时钟可以配置成双向的。 ）
GND
地
测试时钟输入诊断探头和设备
编程。在灵活的方式， TCK变得活跃时
在TMS引脚设置为低电平（参见
表2第8页） 。
该引脚
作为一个I / O时的边界扫描状态机
达到“逻辑复位”状态。
TDI
测试数据输入
低电源电压。
HCLK
专用（硬连线）
阵列时钟
该引脚为3.3V / 5.0V PCI / TTL时钟输入顺序
模块。这个输入被直接连接到每个R单元和
提供的时钟速度独立的R-细胞的数目的
被驱动。如果不使用，该引脚必须置低或高
在黑板上。它不能悬空。
I / O
输入/输出
串行输入边界扫描测试和诊断探针。
在灵活的方式， TDI是活跃在TMS引脚设置为低电平
（参照
表2第8页） 。
该引脚为I / O
当边界扫描状态机到达“的逻辑
复位“状态。
TDO
测试数据输出
在I / O引脚的功能为输入，输出，三态，或
双向缓冲。基于特定的配置，输入
和输出电平与标准TTL ，LVTTL兼容
PCI 3.3V或5.0V的PCI规格。未使用的I / O引脚
由设计师系列软件会自动进入三态。
NC
无连接
串行输出的边界扫描测试。在灵活的方式，
TDO激活时， TMS引脚设置为低电平（参见
表2
第8页） 。
该引脚为I / O时的边界
扫描状态机到达“逻辑复位”状态。
TMS
测试模式选择
该管脚没有连接到该装置内的电路。
PRA ， I / O
探头
该探针引脚从任何用于输出数据
在装置内的用户定义的设计节点。这
独立的诊断引脚可配合使用
该探测器B引脚，允许实时诊断的任何输出
在装置内的信号路径。该探针引脚可用于
作为一个用户定义的I / O时核查已经完成。
该引脚的探头功能，可以永久禁用于
保护编程设计的保密性。
PRB ， I / O
探测器B
TMS管脚控制使用IEEE 1149.1边界
扫描引脚（ TCK， TDI，TDO ） 。在灵活的模式下，当TMS
引脚设置为低电平时， TCK ， TDI和TDO引脚的边界
扫描引脚（参照
表2第8页） 。
一旦边界
扫描引脚处于测试模式下，他们将继续留在该模式
直到内部边界扫描状态机到达
“逻辑复位”状态。在这一点上，所述边界扫描销将
被释放并且将用作普通的I / O引脚。在“逻辑
复位“状态，达到5 TCK周期的TMS引脚被置后
HIGH 。在专用测试模式下，TMS用作在指定
在IEEE 1149.1规格。
V
CCI
电源电压
电源电压的I / O 。看
表1第8页。
V
CCA
电源电压
电源电压为阵。看
表1第8页。
V
CCR
电源电压
该探测器B引脚从内部任意节点用于输出数据
该设备。这个诊断销可以结合使用
用探针引脚，允许实时诊断输出
在装置内的任何信号通路。该探测器B引脚可
用作用户定义的I / O时，验证已
完成。该引脚的探头功能可以永久
残疾人保障编程设计的保密性。
（需要内部电源电压的输入容限
偏置）查看
表1第8页。
34
v3.1
