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LTC2412
应用S我FOR ATIO
U
2.7V至5.5V
1F
1
2
3
4
5
模拟输入范围
–0.5V
REF
到0.5V
REF
6
7
V
CC
LTC2412
REF
+
REF
CH0
+
CH0
V
CC
CS
SDO
SCK
(外部)
转变
数据输出
转变
2412 F07
图7.外部串行时钟, CS = 0操作( 2线)
V后面通常为1ms
CC
超过2V 。电平施加到
SCK ,此时确定是否SCK为内部或外部。
SCK必须以POR ,以便结束驱动为低电平之前
进入外部串行时钟定时模式。
由于CS连接到低电平,则结束转换( EOC )可
在SDO引脚的转换过程中连续监测
和睡眠状态。 EOC可以作为一个中断向
外部控制器,指示转换结果
准备好了。 EOC = 1 ,而在转换过程中和
EOC = 0的一次转换结束。上的下降沿
EOC ,转换结果装入一个内部静态
移位寄存器。数据被移出SDO引脚上的每个
SCK的下降沿使外部电路锁存数据
在SCK的上升沿。 EOC可以在第一锁存
上升SCK边缘。在SCK , SDO的第32届下降沿
变高( EOC = 1 ),表示一个新的转换有
开始。
内部串行时钟,单周期操作
这种定时模式使用内部串行时钟移出
转换结果和CS信号来监控和
控制转换周期的状态,见图8 。
为了选择内部串行时钟的定时模式,该
串行时钟引脚( SCK )必须浮空状态(高阻)或拉
W
31位
EOC
U
U
F
O
14
= 50Hz的抑制
=外部振荡器
= 60Hz抑制
参考
电压
0.1V至V
CC
SCK
SDO
CS
13
12
11
2-WIRE
接口
CH1
+
CH1
GND
8, 9, 10, 15, 16
30位
CH0/CH1
29位
SIG
28位
最高位
27位
26位
第5位
最低位
24
位0
高电平之前的CS的下降沿。该设备将无法
进入内部串行时钟模式下,如果SCK驱动为低电平
在CS的下降沿。内部弱上拉电阻
活跃在CS的下降沿在SCK引脚;
因此,内部的串行时钟的定时模式是自动
matically选择SCK ,如果没有外部驱动。
串行数据输出引脚( SDO )为Hi -Z只要是CS
HIGH 。在转换期间的任何时间, CS可以是
为了监视转换器的状态拉低。
一旦CS被拉低, SCK变为低电平, EOC输出
在SDO引脚。 EOC = 1,而转换过程中
和EOC = 0,如果该设备处于休眠状态。
当测试EOC ,如果转换结束( EOC = 0 ) ,
该设备将退出EOC测试期间睡眠状态。在
为了使该设备返回到低功率休眠
状态, CS必须拉的第一个上升沿之前HIGH
在SCK的。在内部SCK定时模式, SCK变为高电平
和设备开始输出数据,在时间t
EOCtest
CS的下降沿(如果EOC = 0)或叔
EOCtest
之后, EOC变为
LOW (如果CS为低电平EOC的下降沿时) 。该
的T值
EOCtest
是23μs ,如果该设备在使用其内部
振荡器(F
0
=逻辑低或高) 。若F
O
由一个驱动
频率f外部振荡器
EOSC
,则T
EOCtest
is
3.6/f
EOSC
。如果CS前时间t拉高
EOCtest
中,
2412f
19

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