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ADSP-2186L
时钟信号
在ADSP- 2186L可通过计时无论是水晶或
TTL兼容的时钟信号。
在CLKIN输入不能停止，运行过程中改变
或经营低于正常操作在指定的频率
化。唯一的例外是当处理器在上电
关闭状态。对掉电的其他信息
特征，指的是
ADSP -2100系列用户手册，
第三
版。
如果一个外部时钟的情况下，它应该是一个TTL兼容
信号一半的指令速率运行。该信号是CON-
，连接到该处理器的CLKIN的输入。当使用外部时钟
在使用时， XTAL输入必须悬空。
在ADSP- 2186L使用输入时钟，其频率等于
一半的指令速率; 0.20 MHz的输入时钟产生一个25纳秒
处理器周期（相当于40兆赫） 。通常情况下，
指令在单处理机周期执行。所有设备
定时是相对于所述内部指令时钟速率，这是
当启用时由CLKOUT信号指示。
由于ADSP- 2186L包括一个片上振荡器电路，
外部晶体也可以使用。该晶体的连接
横跨CLKIN和XTAL引脚，与两个电容器CON组
连接的，如图3，电容值依赖于
晶型，应该由晶振制造商指定。
并联谐振，基频，微处理器
高档水晶应该被使用。
的时钟输出（ CLKOUT）信号由时处理产生的
SOR在处理器的周期率。这可以使能和
由SPORT0自动缓冲的CLKODIS位禁止
控制寄存器。
法师
RESET
将所有内部堆栈指针为空
堆栈状态，屏蔽所有中断，并清除MSTAT
注册。当
RESET
被释放时，如果不存在未决的总线
请求和所述芯片被配置为引导，所述引导加载
序被执行。第一指令是从取出
芯片上一次引导加载程序存储器地址0x0000
完成。在EZ -ICE兼容系统
RESET
和
EReset
具有相同的功能。有关完整信息，
看到设计的EZ -ICE兼容系统部分。
内存架构
在ADSP- 2186L提供各种存储器和外围设备
接口选项。关键的官能团是程序存储器，
数据存储器，字节的存储器和I / O 。
程序存储器（内存满模式）
是一个24位宽的空间
用于存储两个指令的操作码和数据。在ADSP- 2186L
具有程序存储器RAM 8K字片上，而capabil-
使用访问最多两个8K外部存储器覆盖空间性
外部数据总线。两个指令的操作码和一个数据值
可以从片内程序存储器在一个周期内被读取。
数据存储器（内存满模式）
是一个16位宽的空间
用于数据变量的存储和对存储器映射
控制寄存器。在ADSP- 2186L拥有8K字上的数据
存储器RAM芯片上，由8160的用户可访问的
位置和32个存储器映射的寄存器。支持还存在
用于通过最多两个8K外部存储器覆盖的空间
外部数据总线。
字节的内存（内存满模式）
提供到接入
通过字节DMA（ BDMA ）端口8位宽的存储器空间。
该字节的存储器接口提供4 MB的
存储器通过利用8条数据线的额外的地址线。
这使BDMA端口的有效22位地址范围。上
电时，该DSP能够自动加载自举代码
字节的内存。
I / O空间（完全内存模式）
允许某些地区2048访问
的16比特宽的数据系统蒸发散。它的目的是用于串行通信
美食与并行外围设备，如数据转换器和
外部寄存器或锁存器。
程序存储器
CLKIN
XTAL
CLKOUT
DSP
图3.外部晶体连接
RESET
该
RESET
信号启动ADSP- 2186L的主复位。
该
RESET
信号必须在上电时置位
序，以保证正确的初始化。
RESET
在初始
上电时必须保持足够长的时间以使内部时钟
为稳定。如果
RESET
激活后，电任何时候，
时钟继续运行，并且不需要稳定时间。
上电顺序是德网络定义为所需的总时间
晶体振荡电路的后一个有效V到稳定
DD
is
施加到所述处理器，并且用于内部锁相环
（PLL）锁定到所述特定频率的晶体。最少
2000 CLKIN周期确保了PLL已锁定，但不
不包括晶体振荡器的启动时间。在这
上电顺序的
RESET
信号应保持低电平。上
随后的复位，
RESET
信号必须满足微型
妈妈脉宽规范，T
RSP
.
该
RESET
输入包含一些滞后;然而，如果一个RC
电路被用来产生
RESET
信号，外部施密特
触发器被推荐。
REV 。一
在ADSP - 2186L包含8K
×
24片内程序RAM 。
片上程序存储器被设计为允许最多两个
每个访问周期，使所有操作都可以在一个完整的
单周期。此外，在ADSP- 2186L允许使用8K的
外部存储器覆盖。
的程序存储空间的组织是由控制
模式B引脚和PMOVLAY寄存器。正常情况下， ADSP-
2186L配置了模式B = 0，程序存储器
组织成如图4所示。
程序存储器
地址
0x3FFF
外部8K
（ PMOVLAY = 1或2 ，
模式B = 0 ）
0x2000
0x1FFF
内部8K
0x0000
图4.程序存储器（模式B = 0 ）
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