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摩托罗拉
半导体技术资料
9.0传感器的输出/输入信号
9.1启动数据采集（ SYNC ）
这个信号是由传感器来指示开始使用
整合（数据采集）的单帧滚动
快门捕捉模式（ SFR）的。欲了解更多信息请参考
图15 ，第22页，图8 ，第12页
和
科幻gure
16 ，第24页。
此信号可在内部产生
由传感器或通过传感器的针脚＃ 46驱动
（见
图20 ， 67页） 。
要设置是否信号
在内部或外部产生的，以及其他
设置该信号，参考
同步和频闪控制
寄存器（见表31 ） ，第50页。
9.2启动行读出（ SOF ）
这个信号会触发/指示行读出的开始
该帧的。这个信号是一个输出，并且可以读
通过针＃传感器48 （见
图20 ， 67页） 。
以及它的长度可以通过设置在SOF信号延迟
经由用户
SOF延迟寄存器， （表46） ，页
57
和
SOF & VCLK信号长度控制寄存器，
（见表48 ） ，第57页。
对于时序图描绘
使用在SOF信号的指
图15中，上
第22页，图6 ，第11页，图7 ，第12页
，图
8 ，第12页
和
图16 ，第24页。
ImageMOS
9.3横向数据同步（ VCLK ）
该信号触发顺序的行的读出
该帧的。这个信号是一个输出，并且可以读
通过针＃传感器44 （见
图20 ， 67页） 。
就SOF的VCLK信号延迟，以及其
长度可通过经由用户设置
VCLK延迟注册，
（见表47 ） ，第57页
和
SOF & VCLK信号长度
控制寄存器（见表48 ） ，第57页。
对于时序二
agrams描绘使用VCLK信号的参考toFig-
URE 15 ，第22页，图6 ，第11页，图7 ，上
第12页
，图
8 ，第12页
和
图16中，上
第24页。
9.4数据有效（ HCLK ）
该信号触发/指示单有源像素数据
已行的读出（如第5列10个数据有
被读出） 。这个信号是一个输出，并且可以是
通过传感器的针脚＃ 45读（见
图20中的上
第67页） 。
的HCLK信号延迟可以由用户来设置
通过
HCLK延迟寄存器（见表52 ） ，第60页。
为
时序图描绘了使用的HCLK信号的
请参阅
图15 ，第22页，图6 ，第11页，
图7 ，第12页
和
图8 ，第12页。
MCLK
t
SUSYNC
SYNC
t
HSYNC
t
dSOF
SOF
t
dvclk
VCLK
t
dfhclk
t
drhclk
HCLK
t
DADC
ADC的[9：0 ]
图15 。
像素数据总线Iinterface时序规范（见下表）
摩托罗拉
修订版8.0 - 2001年11月28日：
MCM20027
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