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摩托罗拉
半导体技术资料
如果主机接收器不承认奴隶
一个字节传输后发射,这意味着“结束
数据'的奴隶,这样从释放SDATA线
对主机产生停止或启动的信号。
10.6停止信号
主机可以通过gener-终止通信
阿婷STOP信号以释放总线。然而,中,主机
器可以产生一个起始信号,随后通过调用
命令没有先产生一个STOP信号。这
被称为重复启动。停止信号定义
作为低到高SDATA的过渡,而SCLK为
逻辑“1” (见
图17)。
主机可以产生一个停止,即使从站
生成的确认位,此时从
必须释放总线。
最高位
SCLK
1
2
3
4
5
6
最低位
7
8
9
最高位
1
2
3
4
5
6
7
ImageMOS
10.7重新开始信号
是一个启动信号,产生一个重复启动信号
没有先产生一个停止信号来终止
通信。这被师傅commu-
nicate与其他奴隶或具有相同的奴隶在昼夜温差
同的模式(发送/接收模式)而不释放
总线。
如图
图18中的
一个重新开始信号是BE-
在读周期ING使用和重定向数据
从写周期传输(主机发送寄存器
解决的奴隶),以一个读周期(从器件发送
从指定的寄存器中的数据发送到从站)。
最低位
8
9
SDATA
AD7 AD6 AD5 AD4 AD3 AD2 AD1
“0” “1” “1” “0” “0” “1” “1”
MCM20027我
2
C总线地址
D7
D6 D5
D4
D3
D2 D1
D0
开始
信号
MCM20027注册地址
写ACK
位
从
MCM20027
最低位
确认
位
从
MCM20027
最高位
SCLK 1
2
3
4
5
6
7
8
9
SDATA D7
D6
D5
D4
D3
D2
D1 D0
数据写MCM20027注册
ACK STOP
比特信号
从
MCM20027
采用I2C总线图17.写周期
10.8 I2C总线的时钟和同步
漏极开路输出,在所有的SCLK输出使用
主从设备,这样的时钟可以同步
chronized和使用线与逻辑拉伸。这
意味着最慢的设备将保持大巴从
要快于它能够接收或和Transmit的
婷的数据。
在主机带动SCLK从高至低,所有的
奴隶驱动SCLK为低要求的时期,
需要由每个从站设备,然后释放
SCLK总线。如果从低SCLK周期大于
主SCLK低电平期间,所产生的SCLK总线
信号低电平被延长。因此,同步
时钟发生以来, SCLK保持为低电平由DE-
副最长的低潮期。另外,该方法可以
可以使用由从机减慢的比特率
传输。主控制时间的长短
SCLK线在高状态。在SDATline数据
是有效的,当主从切换SCLK线
高到低。
从设备可容纳完成后, SCLK低
中的一个字节(9位)。在这种情况下,它会暂停总线
时钟和强制主机时钟进入等待状态,直到
从释放SCLK线。
修订版8.0 - 2001年11月28日:
MCM20027
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