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7.0
总线接口单元
7.2.1
BIU配置（与bcfg ）注册
该BIU配置（与bcfg ）寄存器是一个字节宽，读/
写寄存器，要么选择写早或迟写总线
周期。寄存器地址为F900十六进制。在复位时，该
寄存器初始化为07进制。该寄存器的格式示
下文。
7
6 5 4
版权所有
3
2
注1
1
注1
0
EWR
总线接口单元（ BIU ）控制之间的接口
的片上模块和内部核心总线。它决定
配置的参数总线访问（如num-
等待状态的内存访问）和问题了合的误码率
priate总线信号的请求的访问。
7.1
总线周期
有四种类型的数据传输的总线周期：
正常的读
快读
早期写
晚写
注意：
对于写操作，该设备采用了后期写
操作。
在一个特定的交易中使用的数据周期的类型DE-
暂时搁置于CPU的操作的类型（写入或读出） ，所述
的存储器类型或I / O被访问，访问类型
编入BIU控制寄存器（早/晚写或
正常/快速阅读） 。
对于读操作，基本正常的读操作需要两个时钟赛扬
克莱斯，而快速的读总线周期为一个时钟周期。
根据该装置的复位，正常的读总线周期是烯
在默认情况下禁止。
对于写操作，一个基本的迟写总线周期中有两个
个时钟周期，而基本初写总线周期来
三个时钟周期。根据该装置的复位，早期写总线
周期是默认启用的。但是，后期写总线周期
需要对普通的写操作，所以这种组态
灰应由应用程序软件被改变（见
Section7.2.1).
在某些情况下，一个或多个附加的时钟周期是添加 -
编到总线访问周期。有两种类型的附加
时钟周期，对于普通内存访问，称为内部
等待周期（ TIW ）和保持（的Thold ）周期。
一个等待周期只是内存后插入一个总线周期
地址已被放置在地址总线上。这给出了
访问内存更多的时间来对交易作出回应
请求。甲保持周期被插入在一个总线周期结束。
此保持数据总线上的数据进行扩展的数
的时钟周期。
EWR
早期写。该位清0后写
操作（ 2个时钟周期来写）或设置为1
对于早期的写操作。
注1 ：
这个位（ 1或第2位）控制的配置
在模拟设备中使用的224引脚器件。该CPU
应该设置该位为1时，写入该寄存器。
复位时，与bcfg寄存器初始化为07进制，这
选择早期的写操作。然而，后写入操作是
所需设备的正常运行，所以软件应
该寄存器的值更改为06进制。
7.2.2
I / O区的配置（ IOCFG ）注册
在I / O区的配置（ IOCFG ）寄存器是一个字宽，
读/写寄存器，用于设置时间和总线characteris-
我抽动/ O区的内存访问。在设备implemen-
塔季翁，相关联的端口B和端口C寄存器位于
在I / O存储器阵列。 （这些端口被用作一个16位的数据
端口，如果该设备工作在发展模式。 ）
该IOCFG寄存器地址为F902十六进制。在复位时，该
寄存器被初始化为069F （十六进制） 。该寄存器的格式
如下所示。
15
14 13 12
版权所有
11
10
1
4
3
HOLD
9
IPST
2
8
版权所有
1
等待
0
7
BW
等待
6
5
版权所有
7.2
BIU控制寄存器
HOLD
该BIU有一组控制寄存器，确定如何
许多等待周期和保持周期是用于访问 -
荷兰国际集团的记忆。当启动该设备时，这些寄存器
应当用适当的值，以便被编程的
周期的最小允许次数被使用。这个数字
随所用的时钟频率。
有两种适用BIU寄存器： BIU的配置
化（与bcfg ）寄存器和静态区0配置
（ SZCFG0 ）寄存器。这些寄存器控制总线周期
配置用于访问闪存程序存储器。
注意：
系统配置寄存器称为模块
配置（ MCFG ）寄存器控制等待数
用于访问EEPROM数据存储器周期。这
寄存器中的第4.2节中描述。
BW
内存等待周期
此字段指定TIW的数量（内部
等待每个内存加状态）时钟周期
上网，从000二进制无额外
tional TIW等待周期为111二元七
另外TIW等待周期。这些位会忽
接异或，如果SZCFG0.FRE位被设置为1 。
内存保持周期
此字段指定的Thold的时钟数
用于每个存储器存取周期，范围
从00二进制文件没有的Thold周期为11的二进制
为三颗T保持时钟周期。这些位会忽
接异或，如果SZCFG0.FRE位被设置为1 。
总线宽度
BW定义了我的外部总线宽度/ O
区。总线宽度被重置为在初始化它的
默认值，它是16位。如果该位为
清除为0的外部总线是8位宽。对
设置为外部总线宽度为16位，该位
被设置为1。对于80针封装的总线
宽度必须被设置为1。当使用该装置
在224引脚封装的模拟器设备
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