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在关闭省电操作，从而降低功率变
消费和辐射。这只有当完成
该模块检测到切换低速振荡器。如果低
振荡器不工作，预分频器仍然可用
能为慢时钟源。
11.6
双时钟和复位寄存器
双时钟和复位模块（ CLK2RES ）包含两个
寄存器：时钟和复位控制寄存器（ CRCTRL ）
而慢时钟分频器寄存器（ PRSSC ） 。
11.6.1
时钟和复位控制寄存器（ CRCTRL ）
11.4
上电复位
上电复位电路产生系统复位信号
在上电时和保持信号有效的期间的
时间，使晶体振荡器来稳定。该电路DE-
tects一个电源接通状态，该预设的14位的时序
呃到3FFF十六进制。一旦振荡开始，并且时钟
变为有效时，定时器开始倒计时。当
计数到达零，则14位的定时器停止计数和
内部复位信号无效（除非RESET引脚
保持低） 。
该电路在检测到设定的上电复位标志位
上电状态。 CPU可以读取该标志来确定
是否复位由上电或复位所致
输入。
注意：
上电复位电路，不能被用来检测一个
滴在电源电压。
时钟和复位控制寄存器（ CRCTRL ）是一个字节宽
读/写寄存器包含上电复位标志和
选择慢时钟的类型。该寄存器的格式示
下文。
7
6
5
4
版权所有
3
2
1
POR
0
SCLK
SCLK
POR
11.5
外部复位
11.7
慢时钟选择。当此位被设置为1，则
32.728 kHz振荡器用于慢时钟。
当该位被清0时，预分频
主时钟用于所述慢时钟。一旦重新
设置后，该位被清0 。
上电复位。该位被设置为1时
当上电条件是detect-硬件
版，允许CPU来确定是否
发生电。该CPU可以清除
该位为0 ，但不能将其设置为1。任何企图
由CPU来设置该位被忽略。
低电平有效的复位输入管脚称为复位允许器件
在任何时间被重新设定。当信号变为低电平时，它gener-
阿泰认为保持有效，直到一个内部系统复位信号
复位信号再次变高。
慢时钟分频器寄存器
（ PRSSC ）
慢速时钟分频器（ PRSSC ）寄存器是一个字节宽
读/写寄存器，用于存放用来产生时钟分频
吃了从主时钟慢时钟。该稳压的格式
存器如下所示。
7
6
5
4
3
SCDIV
2
1
0
SCDIV
慢时钟分频。如果时钟分频器恩
禁止时（ CRCTRL.SCLK = 0 ）时，主时钟是二
由（ SCDIV + 1） vided * 2 ，以产生缓慢
系统时钟。复位时， PRSSC寄存器
设置为十六进制的FF 。
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