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HYMD264646B(L)8J-J
功能框图
/CS1
/CS0
DQS0
DM0
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
/ CS
的DQ
DQS4
DM4
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
D0
I/O3
I/O4
I/O5
I/O6
I/O7
D8
D4
D12
D12
DQS1
DM1
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DQS5
DM5
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
D1
D9
D5
D13
DQS2
DM2
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DQS6
DM6
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
D2
D10
D6
D14
DQS3
DM3
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DQS7
DM7
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
DM
I/O0
I/O1
I/O2
I/O3
I/O4
I/O5
I/O6
I/O7
/ CS
的DQ
D3
D11
D7
D15
VDD SPD
VDD / VDDQ
SPD
DO-D15
DO-D15
DO-D15
表带：见注4
*时钟布线
时钟输入
* CK0 ， / CK0
* CK1 ， / CK1
* CK2 ， / CK2
SDRAM的
4 SDRAM的
6 SDRAM的
6 SDRAM的
SCL
WP
串行PD
SDA
A0
A1
A2
SA2
VREF
VSS
VDDID
*每个时钟加载线
表/接线图
SA0 SA1
注意：
BA0-BA1
A0-A13
CKE1
/ RAS
/ CAS
CKE0
/ WE
BA0 - BA1 ： SDRAM的D0 -D15
A0 - A13 ： SDRAM的D0 -D15
CKE ： SDRAM的D8 -D15
/ RAS ： SDRAM的D0 -D15
/ CAS ： SDRAM的D0 -D15
CKE ： SDRAM的D0 - D7
/ WE ： SDRAM的D0 -D15
1. DQ到I / O接线如图推荐，但可能
被改变。
2. DQ / DQS / DM / CKE / S的关系必须保持
如图所示。
3. DQ ， DQS ， DM / DQS电阻： 22欧姆
±
5%.
4. VDDID表带连接
（对于存储设备VDD ， VDDQ ） ：
表带OUT （ OPEN ） ： VDD = VDDQ
表带（ VSS ） ： VDD
≠
V DDQ
5. BAX ，斧， RAS ， CAS，WE电阻： 3欧姆
±
5%
修订版0.2 /十二月02
3
