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M24256, M24128
呃时钟，主机必须具有漏极开路输出
放，和一个上拉电阻，必须从连接
SCL线为V
CC
。 （图3表示如何
上拉电阻器的值可以被计算） 。在
同步的大多数应用中，虽然，这种方法
nization不采用，因此上拉电阻
器是没有必要的，只要主人有
推挽（而不是开路漏极）输出。
串行数据（ SDA ）
SDA引脚是双向的，而且是用来反式
或缩小存储器的FER数据。这是一个漏极开路
输出可能是线或运算与其他开放
漏，或在公共汽车上集电极开路信号。上拉
电阻必须从SDA总线连接
到V
CC
。 （图3表示的是如何的价值
上拉电阻可以计算） 。
写控制（ WC ）
硬件写控制引脚（ WC ）是有用的
保护存储器的整个内容从
意外的擦/写。所述写控制信号是
用于使能（WC = V
IL
）或禁用（ WC = V
IH
)
写指令来对整个存储器区。当
未连接时， WC输入在内部读作
V
IL
，被允许和写操作。
当WC = 1 ，设备选择和地址字节
是公认的，数据字节非应答
边。
请参阅应用笔记
AN404
为更
写入控制功能的详细描述。
设备操作
所述存储器装置支持我
2
C协议。
这总结在图4中，与比较
在应用笔记其它串行总线协议
AN1001
。发送到总线的数据的任何设备
被定义为一个发送器，并且任何装置
读取的数据是一个接收器。该装置
控制数据传输被称为大师，
和另一个作为从机。数据传输只能
由主器件启动，这也将提供
串行时钟进行同步。内存
设备始终在所有通信从站设备
化。
启动条件
开始是由一个高鉴定到的低转换
SDA线，而时钟，SCL是稳定的，在
高状态。启动条件必须先于任何
数据传输命令。存储器器件所
连续监控（除了一个编程期间
为启动条件的周期）的SDA和SCL线
化，并且不会响应，除非给出一个。
停止条件
停止由低识别到高过渡
SDA线而时钟SCL为稳定的高
状态。停止条件终止通信
所述存储装置和总线mas-之间和灰
之三。在读的最后一个停止条件
命令后（只有经过）的Noack ，势力
存储设备插入其待机状态。一个停止
条件在Write指令的触发器的端
内部EEPROM写周期。
确认位（ ACK ）
一个确认信号被用于指示一个suc-
cessful字节传输。总线发射器，无论是
它是主机或从机，后释放SDA总线
发送8位数据。在9
th
时钟
脉冲周期，接收器拉SDA总线低
确认所收到的八个数据位。
数据输入
在数据输入时，该存储器器件样品的
在时钟的上升沿，SDA总线信号，
SCL 。对于正确的设备操作， SDA信号
图3.最大R
L
值与总线电容（C
公共汽车
）为一个余
2
C总线
VCC
20
最大RP值（千欧）
16
RL
12
8
4
0
10
100
CBUS （PF ）
AI01665
RL
SDA
主
FC = 100kHz的
FC = 400kHz的
SCL
CBUS
CBUS
1000
3/17
