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AD73422
抽取滤波器
在AD73422的AFE部分使用的数字滤波器进行
两个重要的功能。首先，它消除了对带外
量化噪声，它是由模拟调制器形
其次，它抽取高频比特流于
率较低的16位字。
抗混叠抽取滤波器是一个正弦-立方数字滤波器
这减少了来自DMCLK / 8至DMCLK /采样率
256 ，并增加了从单个位的分辨率，以15位或
更大（这取决于所选择的采样速率） 。其Z变换为
给定为： [（ 1 -Z的
–N
)/(1–Z
–1
)]
3
其中，N是由采样速率设置
（N = 32 @ 64 kHz的采样。 N = 256 @ 8 kHz采样）
因此，当采样速率为64 kHz的最小群延迟
25
s
可以实现的。
字生长在抽取由采样确定
率。在64 kHz的采样之间，其中过采样率
Σ-Δ调制器和抽取器输出等于32 ，我们得到
每三个阶段的Sinc3滤波器的级5位。由于对称性
尝试的Σ-Δ调制器中， LSB总是有一个
零，因此，在16位ADC的输出字将具有2个LSB
等于零， 1由于Σ-Δ对称性和
另一种是填充零，以弥补在16位字。在
较低的采样率，抽取单词的增长会更大
大于16位的取样字，因此截断发生在
转移作为ADC字抽取输出。例如
在8 kHz采样，文字的增长达到由于OSR 24位
256的Σ-Δ调制器和抽取器输出之间。
这会产生每3级的Sinc3滤波器的阶段8位。
ADC编码
所述输出字被设定为0x7FFF，那么它具有的最低位设置为1 。
在混合控制/数据模式下，分辨率固定为15位，
与16位传送的MSB被用作一个标志位，以
表明在帧控制或数据。
解码器通道
该解码器的通道由数字内插器，数字
Σ-Δ调制器，单比特数字 - 模拟转换器
（ DAC ） ，模拟平滑过滤器和可编程增益扩增
fiers与差分输出。
DAC编码
该DAC编码方案是在二进制补码格式
0x7FFF的是全面积极为0x8000是全面
消极的。
插值滤波器
抗成像的内插滤波器是一个正弦内-立方数字滤波器
该上采样的输入采样的16位的输入字
率DMCLK / 8的速度，同时过滤衰减图像
由内插过程中产生的。其“ Z变换给出
为： [（ 1-z
–N
)/(1–Z
–1
)]
3
其中，N是由取样测定
率（N = 32 @ 64 kHz的。 N = 256 @ 8千赫） 。该DAC重
才能享有的16位样本从主DSP处理器的亲
的DMCLK / N编程的采样率。如果主处理器出现故障
写一个新值到串行端口，现有的（前）
数据被再次读取。该数据流是由抗镜像滤波
内插滤波器，但有一个选项，以绕过插补
通过设置荡器的最小群延迟配置
IBYP位（ CRE ： 5 ）控制寄存器E的内插滤波器
有相同特性的ADC的抗混叠decima-
灰滤镜。
内插滤波器的输出被输入到DAC的数字
Σ-Δ调制器，其中， 16位数据转换为1位
样品在DMCLK / 8的速率。调制器的噪声形状
使固有误差的处理被最小化的信号
该转换器的通频带。的比特流输出
Σ-Δ调制器被馈送到单个位的DAC ，其中它是
转换为模拟电压。
模拟平滑滤波和PGA
ADC的编码方案是二进制补码格式（见
图6）。所述输出字由抽取形成的
过滤器，其从所述单一比特输出生长的字长
Σ-Δ调制器，以高达18比特的字长度
（这取决于所选择的抽取率），这是最后的输出
把ADC块。在数据模式下该值将被截断为
16位的串行数据输出（ SDO ）引脚输出。为
输入值等于或大于正的满量程，然而
V
REF
+ (V
REF
0.32875)
V
FBP
类似物
输入
V
REF
V
REF
– (V
REF
0.32875)
V
FBN
10...00
00...00
01...11
ADC码差分
单个位的DAC的采样DMCLK / 8的输出，
因此，有必要对过滤输出来重构
低频信号。解码器的模拟平滑滤波器
由前面有一个三阶连续时间滤波器的
开关电容滤波器。连续时间滤波器形成部分
输出可编程增益放大器（ PGA ） 。美巡赛
可用于调整输出信号电平从-15 dB到
6分贝在3分贝步骤，如表II所示。 PGA增益为
在控制：由位OGS0 ， OGS1和OGS2 （4-6 CRD ）设置
D.注册
表II中。 PGA设置的信道解码器
V
REF
+ (V
REF
0.6575)
V
FBP
OGS2
0
0
0
0
1
1
1
1
OGS1
0
0
1
1
0
0
1
1
OGS0
0
1
0
1
0
1
0
1
增益（dB ）
+6
+3
0
–3
–6
–9
–12
–15
类似物
输入
V
REF
V
REF
– (V
REF
0.6575)
V
FBN
10...00
00...00
01...11
ADC CODE单端
图6. ADC传递函数
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第0版
