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512MB , 1GB , 2GB Registered DIMM内存模组
引脚配置(正面/背面)
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29
30
DDR2 SDRAM
A4
V
DDQ
A2
V
DD
关键
V
SS
V
SS
V
DD
NC / Par_In
V
DD
A10/AP
BA0
V
DDQ
WE
CAS
V
DDQ
S1
4
V
REF
V
SS
DQ0
DQ1
V
SS
DQS0
DQS0
V
SS
DQ2
DQ3
V
SS
DQ8
DQ9
V
SS
DQS1
DQS1
V
SS
RESET
NC
V
SS
DQ10
DQ11
V
SS
DQ16
DQ17
V
SS
DQS2
DQS2
V
SS
DQ18
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150
V
SS
DQ4
DQ5
V
SS
DM0/DQS9
NC/DQS9
V
SS
DQ6
DQ7
V
SS
DQ12
DQ13
V
SS
DM1/DQS10
NC/DQS10
V
SS
俄罗斯足协
俄罗斯足协
V
SS
DQ14
DQ15
V
SS
DQ20
DQ21
V
SS
DM2/DQS11
NC/DQS11
V
SS
DQ22
DQ23
31
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60
DQ19
V
SS
DQ24
DQ25
V
SS
DQS3
DQS3
V
SS
DQ26
DQ27
V
SS
CB0
CB1
V
SS
DQS8
DQS8
V
SS
CB2
CB3
V
SS
V
DDQ
CKE0
V
DD
NC
NC / Err_Out
V
DDQ
A11
A7
V
DD
A5
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179
180
V
SS
DQ28
DQ29
V
SS
DM3/DQS12
NC/DQS12
V
SS
DQ30
DQ31
V
SS
CB4
CB5
V
SS
DM8/DQS17
NC/DQS17
V
SS
CB6
CB7
V
SS
V
DDQ
CKE1
4
V
DD
NC
NC
V
DDQ
A12
A9
V
DD
A8
A6
61
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64
65
66
67
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90
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210
V
DDQ
A3
A1
V
DD
CK0
CK0
V
DD
A0
V
DD
BA1
V
DDQ
RAS
S0
V
DDQ
ODT0
A13
V
DD
V
SS
DQ36
DQ37
V
SS
DM4/DQS13
NC/DQS13
V
SS
DQ38
DQ39
V
SS
DQ44
DQ45
V
SS
91
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93
94
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96
97
98
99
100
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118
119
120
V
SS
DQS5
DQS5
V
SS
DQ42
DQ43
V
SS
DQ48
DQ49
V
SS
SA2
数控(TEST)
V
SS
DQS6
DQS6
V
SS
DQ50
DQ51
V
SS
DQ56
DQ57
V
SS
DQS7
DQS7
V
SS
DQ58
DQ59
V
SS
SDA
SCL
211
212
213
214
215
216
217
218
219
220
221
222
223
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229
230
231
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233
234
235
236
237
238
239
240
DM5/DQS14
NC/DQS14
V
SS
DQ46
DQ47
V
SS
DQ52
DQ53
V
SS
俄罗斯足协
俄罗斯足协
V
SS
DM6/DQS15
NC/DQS15
V
SS
DQ54
DQ55
V
SS
DQ60
DQ61
V
SS
DM7/DQS16
NC/DQS16
V
SS
DQ62
DQ63
V
SS
VDDSPD
SA0
SA1
ODT1
V
DDQ
V
SS
DQ32
DQ33
V
SS
DQS4
DQS4
V
SS
DQ34
DQ35
V
SS
DQ40
DQ41
NC =无连接,足协=保留供以后使用
1. RESET (引脚18 )连接到PLL的两个OE和复位寄存器。
2.测试引脚(引脚102 )被保留用于总线分析探针和连接不正常的内存模块(DIMM )
3. NC / Err_Out (引脚55 )和NC / Par_In (引脚68 )是可选的函数来检查地址和命令校验。
4. CKE1 , S1引脚用于双面注册的DIMM。
引脚说明
引脚名称
CK0
CK0
CKE0 , CKE1
RAS
CAS
WE
S0, S1
A0~A9, A11~A13
A10/AP
BA0 , BA1
SCL
SDA
SA0~SA2
Par_In
Err_Out
RESET
描述
时钟输入端,正线
时钟输入端,负极线
时钟使能
行地址选通
列地址选通
写使能
芯片选择
地址输入
地址输入/ Autoprecharge
DDR2 SDRAM行地址
串行存在检测( SPD )时钟输入
SPD数据输入/输出
SPD地址
奇偶校验位的地址和控制总线
在地址和控制总线发现奇偶校验错误
寄存器和PLL控制引脚
引脚名称
ODT0~ODT1
DQ0~DQ63
CB0~CB7
DQS0~DQS8
DQS0~DQS8
DQS9~DQS17
俄罗斯足协
NC
TEST
V
DD
V
DDQ
V
SS
V
REF
V
DDSPD
片上终端
数据输入/输出
数据校验位输入/输出
数据选通信号
数据选通信号,负线
数据选通脉冲(读) ,负极线
留作将来使用
无连接
内存总线测试工具
(不连接,并没有可用的DIMM上)
核心动力
I / O电源
输入/输出参考
SPD电源
描述
DM ( 0 8 ) , DQS ( 9 17 )数据掩码/数据选通(读)
* VDD和VDDQ引脚连接到单电源平面的PCB 。
修订版1.3 2005年08月

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